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用户39557
2009-12-5 22:32
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基于Nios 软核处理器的七段数码管动态显示设计
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SOPC(System On Programmable Chip)技术是美国Altera公司于2000年最早提出的，并同时推出了相应的开发软件Quartus II。SOPC是基于FPGA解决方案的SO ...
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用户1122702
2009-12-5 21:07
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Altera FIFO使用注意事项
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Altera FIFO使用注意事项 (by Wind330) 使用两年多的Altera器件，总觉得自己对FIFO这类简单的Core已经是 ...
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用户39557
2009-12-5 18:49
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quartus ii 管脚映射
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管脚 映射 有两种方法 （1）在" Assignment"中选择"Pin Planner",之后在location选项中挨个选择，当然这需要花一定的时间如果你的管脚比较多的话。 ...
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用户237744
2009-12-5 17:53
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今天建设部门调查“楼薄薄” 开发商已低头认错
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无锡一市民在高尚住宅区买了一套房子，结果装修时发现楼板厚度明显不达标，打个孔就被轻易打穿了，昨日本报对此事予以报道。该报道引起无锡市有关方面高度重视， ...
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用户39557
2009-12-5 17:13
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nios II 实验五 数码管显示数字钟（定时器实现 外部中断)
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nios II 实验五 数码管显示数字钟（定时器实现 外部中断调节） #include "system.h" //包含基本的硬件 ...
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用户39557
2009-12-5 15:51
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【转】Nios 开发流程 （7位数码管控制）
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上个例子中，我们使用VHDL语言，根据FPGA管脚与数码管和按键管脚的连接，通过一系列的语句控制管脚电平的高低，从而让FPGA实现数码管显示功能。可见，对于比较简 ...
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用户243308
2009-12-5 14:07
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上海到长春专线记者将所掌握的情况
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上海到长春专线记者将所掌握的情况 上海到长春专线 宣传单张上面的“免费查询兑奖专线”和“公证处监督专线”是私人手机号码。记者查询北京114， ...
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用户1651241
2009-12-4 21:41
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关于Cyclone III器件的工作频率
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在进行FPGA设计之前，首先会根据设计的要求，选择不同的FPGA器件，选择FPGA器件的时候，一般需要考虑内部资源和价格，而内部资源的要求又包括以下几方面： ...
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用户238311
2009-12-4 21:10
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综合的约束
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black_box_pad_pin?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / 声明用户定义的黑盒的管脚，作为外部环境 ...
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用户191244
2009-12-4 17:19
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基于Verilog时钟设计
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上传了VHDL以来，陆续接到一些挑战，网友们的设计方案真是个有千秋，而且平台不同，语言也不同。下面是Verilog的时钟模板部分仅供参考。 EDA电子时钟程 ...
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用户191244
2009-12-4 17:06
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VHDL电子时钟程序（续）
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网友热心提供了VHDL 电子时钟设计程序代码，并指出我的程序存在的问题，在此感激不尽。下面是接着上篇博文的时钟设计程序。 VHDL电子钟程序（例化程序）libra ...
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用户191244
2009-12-4 16:58
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VHDL电子时钟程序
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最近收到网上朋友们来信咨询如何设计电子时钟，也有很多热心朋友把他设计的时钟或时钟程序发给我。因时间和水平有限不能一一回复和审查到底哪些是合格或是网络 ...
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用户1122702
2009-12-4 10:42
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BUFGMUX使用注意事项
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BUFGMUX使用注意事项 (by Wind330) 有时我们的系统有多路异步数据源经过FPGA片选后，再进入至数据处理 ...
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用户39557
2009-12-3 17:19
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nios II标准（Standard)系统的创建(3)
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第三节：在QuartusII中使用上述niosII系统 1。在编译完成后。首先在QuartusII中，打开SOPC Builder生成的sopc_ezC6Be_StdF50.bsf,检查一下引脚，看看跟你的设 ...
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用户39557
2009-12-3 17:18
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nios II标准（Standard)系统的创建(2)
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10.为系统添加sys_clk_timer。 双击左边的Other - interval timer,为系统添加timer,请按照如下图片配置。我把它改名（rename）为sys_clk_timer, 11. ...
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