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特权ilove314 2016-3-17 22:12
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西西在冰城 2016-3-17 13:31
- 【西西学FPGA】Lesson 6
- Lesson 6 2016.3.12 罗鹏春、宾立武 1 键盘矩阵 2 矩阵键盘 移位显示 3 加法器 4 二进制转BCD码算法
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- 第四讲 宾立武 状态机 top—down IP ram rom 调用 实验： 1 I_Love_You 字符检测 2 Top—down 分模块设计：1个四分频，1个16分频 ，一个运算 ...
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用户1866459 2016-3-10 21:37
- AVR微控制器处理正交编码器信号只需不到1μs的时间
- 高速读取正交编码器信号(比如1MHz，或1m/s，分辨率是1μm)通常需要专用硬件。本设计实例展示了一种简单的方案，它只使用了一个型号为ATtiny2313A的AVR微控制器就 ...
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- Xilinx FPGA入门连载56：FPGA 片内异步FIFO实例之FIFO配置
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用户945798 2016-3-9 10:38
- 第7讲 SPI和RAM IP核
- 由于本人写的博客文章字数多、图片也多，上传到EDN China网站时常出现图片模糊不清和超字数的现象。后经多番查找资料发现微软的Windows live wri ...
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- 第8讲 异步并行接口时序设计（清晰版）
- http://www.cnblogs.com/huangsanye/p/5256264.html
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- 第8讲 异步并行接口时序设计
- 【学习目的】 ① 学习异步并行接口的读写时序操作，掌握异步并口的时序描述方法； ② 复习 inout 双向端口的 Verilog HDL 描述方法 ...
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- Xilinx FPGA入门连载55：FPGA 片内异步FIFO实例之功能概述
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