FPGA和CPLD-可编程逻辑器件-第68页-面包板社区

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西西在冰城 2016-3-28 13:11: 【西西学FPGA】Lesson 8; 1 keyboard 2 多位加法器 keyboard遇到的问题 1 col在循环扫描，因此当有按键按下的时候，row应该有三个tq的高电平，一个tq的低电平，因此要合理选择 ...; 918 22 0 22

矩阵键盘

用户1826666 2016-3-23 21:57: 浅谈FPGA学习之奇葩分频体验; 前几天在一家做逻辑设计的公司里做了一道笔试题，有些心塞。用 Verilog HDL 描述三分频的实现。说实话，一开始我是拒绝的。我之前做过分频实验，几百毫秒的 ...; 1244 3 2 5

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特权ilove314 2016-3-22 21:54: Xilinx FPGA入门连载62：基于SRAM批量读写的UART bulk测试; Xilinx FPGA 入门连载 62 ：基于 SRAM 批量读写的 UART bulk 测试特权同学，版权所有配套例程和更多资料下载链接： http://pan ...; 1789 11 2 9

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用户54562 2016-3-22 15:05: FPGA实现冒泡排序法（VHDL）; 可能很多人会问，为什么用FPGA来实现冒泡排序？放CPU中用C语言只需短短几行代码即可实现的事情为啥用逻辑来实现，没办法我加入这个项目的时候系统方案已确定 ...; 5111 14 1 15

fpga vhdl 冒泡排序

西西在冰城 2016-3-22 09:14: 【西西学FPGA】Lesson 7; 1 BCD_bin 2 Bin_BCD 作业：两位加法器总结：在设定状态转换的时候，要考虑初始状态，要考虑默认输入，要考虑跳转状态 2 状态转换，数据输入的时 ...; 822 13 0 13

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小梅哥 2016-3-21 15:43: 【博客大赛】小梅哥FPGA博文系列时隔半年，是时候该回归了; 各位EDNChina的网友，一晃，小梅哥已经大半年没来EDNChina发表博客了。回顾上一次发表博客，还是在15年6月20号。如今，已经16年了。这段日 ...; 3231 21 35 39

fpga fpga开发板博客大赛小梅哥芯航线 fpga视频教程

用户1826666 2016-3-21 10:06: 浅谈FPGA学习之逻辑初体验; 校招未至，社招先行。网投了几家公司，基本都有回复，算是多一些机会吧。几天忙在笔试与面试中，说实话，社招公司对项目经历更看重，相应能力要 ...; 1296 2 3 5

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特权ilove314 2016-3-20 22:20: Xilinx FPGA入门连载61：FPGA 片内ROM FIFO RAM联合实例之chipscope在线调试; Xilinx FPGA 入门连载 61 ： FPGA 片内 ROM FIFO RAM 联合实例之 chipscope 在线调试特权同学，版权所有配套例程和更多资料下载 ...; 1091 13 0 13

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用户429290 2016-3-18 10:56: 评论：@sunyzz 博客中提到的“【博客大赛】以太网CRC校验硬件实现的技巧”; zemezhuan; 560 2 0 2

用户429290 2016-3-18 10:53: 评论：@sunyzz 博客中提到的“【转】CRC32详解”; crc32; 561 2 0 2

特权ilove314 2016-3-17 22:12: Xilinx FPGA入门连载60：FPGA 片内ROM FIFO RAM联合实例之功能仿真; Xilinx FPGA 入门连载 60 ： FPGA 片内 ROM FIFO RAM 联合实例之功能仿真特权同学，版权所有配套例程和更多资料下载链接： ht ...; 1066 11 0 11

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西西在冰城 2016-3-17 13:31: 【西西学FPGA】Lesson 6; Lesson 6 2016.3.12 罗鹏春、宾立武 1 键盘矩阵 2 矩阵键盘移位显示 3 加法器 4 二进制转BCD码算法; 826 15 0 15

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西西在冰城 2016-3-17 13:30: 【西西学FPGA】Lesson 5; Lesson 5 2016.3.12 罗鹏春 1 数码管驱动 2 两位数码管显示计数器 3 “I_LOVE_FPGA”数码管移位显示 4 消抖【备注】实验重新做一遍，tb重新写一 ...; 717 10 0 10

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西西在冰城 2016-3-17 13:29: 【西西学FPGA】Lesson 4; 第四讲宾立武状态机 top—down IP ram rom 调用实验： 1 I_Love_You 字符检测 2 Top—down 分模块设计：1个四分频，1个16分频，一个运算 ...; 823 10 0 10

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西西在冰城 2016-3-17 13:28: 【西西学FPGA】Lesson 3; FPGA 第三讲（上） 2016.3.5 罗鹏春 1 奇偶分频（两个沿都计数） 2 流水灯（位拼接）（左移丢数据，位拼接则循环） 3 sclk，s_ rst_n 赋值写在一个ini ...; 745 8 0 8

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