FPGA/CPLD
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用户1692502 2013-7-16 21:46
基于FPGA的电子设计竞赛电路板的设计与实现
   引言   全国大学生电子设计竞赛至今已成功举办了八届, 参赛人数越来越多, 竞赛规模越来越大。大学生电子竞赛在培养学生创新能力、促进高校学风建设 ...
用户1692502 2013-7-16 21:33
比较Altera与Xilinx带ARM处理器的FPGA哪个更好?
  如今FPGA开始带ARM处理器了。赛灵思(Xilinx)的称作可扩展处理平台,取名Zynq;Altera的称作集成ARM处理器的SoC FPGA。今年3月份,赛灵思推出Zynq;今年10 ...
用户423052 2013-7-16 20:19
EDN China 书友会集锦
       “也许人们会忘记你做过多少项目,干过多少工程,但一定会记住你写过的一本好书。” 2008年,EDNChina的资深网友程序匠人同学出版了《匠人手记》 ...
用户1444007 2013-7-16 03:58
Modelsim仿真总结
  Modelsim仿真小结  Iyoyoo     Modelsim的基本仿真流程大致分以下几个步骤:建库、编译工程、前后仿真、调试等。Modelsim仿真既可以在mod ...
asus119_412419641 2013-7-15 23:37
FPGA代码设计规范整理
  1、设计中的FIFO、状态机接口需要有异常恢复状态和状态上报机制,格雷码电路防止被综合电路优化掉。 a)自行设计的格雷码FIFO(一般用于连续数据 ...
用户1718548 2013-7-15 23:18
分频引发的折腾
总的来说今天做的相当失败,本来只是想跟着特权的视频实现个简单的分频,熟练下前两天学的,谁知道又是一堆事情。 分频本是实现相当简单,我自信绝对不会有 ...
asus119_412419641 2013-7-15 22:03
FPGA代码设计规范整理
  1、设计中的FIFO、状态机接口需要有异常恢复状态和状态上报机制,格雷码电路防止被综合电路优化掉。 a)自行设计的格雷码FIFO(一般用于连续数据 ...
asus119_412419641 2013-7-15 21:58
FPGA代码设计规范整理
  1、设计中的FIFO、状态机接口需要有异常恢复状态和状态上报机制,格雷码电路防止被综合电路优化掉。 a)自行设计的格雷码FIFO(一般用于连续数据 ...
sunyzz 2013-7-15 17:09
【转】FPGA之网络编程(DE2_UDP)
http://www.360doc.com/content/12/0426/11/7769620_206630142.shtml   一文和下面的文章结合看效果比较好 前一篇文章写过关于利用DM9000A发送一些数 ...
sunyzz 2013-7-15 11:09
【转】寄存器_触发器_锁存器区别与联系
1.1 寄存器   在实际的数字系统中,通常把能够用来存储一组二进制代码的同步时序逻辑电路称为寄存器.由于触发器内有记忆功能,因此利用触发器可以方便地构 ...
sunyzz 2013-7-13 20:47
[博客大赛]我的compression毕设3-DMA传输
一:DMA传输基本原理 二:举例 1)从SDRAM中读取数据,然后写入到我的模块,SDRAM地址是递增的,我的模块地址是不变的 void wr_cp_blk(int wr_n ...
sunyzz 2013-7-13 10:11
[博客大赛]我的compression毕设3-sopc软硬件开发流程
硬件部分: 一:用户自定义设计好之后,将其按照 Avalon 总线规范进行封装,添加到系统中,如下,添加新的 component ,即你的世设计 添加 ...
用户424825 2013-7-10 20:14
Verilog新手上路教程
Verilog  新手上路教程,给出了常用的数字电路积木块的参考代码。 出于作者本人对排版格式的特殊癖好,请下载附件的PDF ...
daydayup_yao_738579509 2013-7-6 15:23
评论:@EDNChina电子工程师的设计灵感之源 博客中提到的“更新!!FPGA经典100问五大分类全部上映!”
及时雨
用户1336690 2013-7-5 10:02
评论:@coyoo's Blog 博客中提到的“【博客大赛】ALTERA器件中复位电路实现之-异步复位”
ALTERA器件中复位电路实现之-异步复位:值得学习哦
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