FPGA/CPLD
首页 FPGA/CPLD
用户442596 2013-8-17 12:19
基于单片机和CPLD的高精度数据采集系统设计
   1 引言   数据采集系统的任务,就是采集传感器输出的模拟信号转换成计算机能识别的数字信号,送入计算机,将计算机得到的数据进行显示或打印,以便实 ...
用户442596 2013-8-17 12:18
一种基于FPGA的UART电路实现
1 引 言 UART 即通用异步收发器,他广泛使用串行数据传输协议。UART 功能包括微处理器接口、用于数据传输的缓冲器(Buffer)、帧产生、奇偶校验、并串转换,用 ...
特权ilove314 2013-8-16 11:27
Nexys3学习手记2:建立自己的开发环境
          接过Nexys3时,本以为能够提供一张资料光盘,结果大失所望,除了静电袋里一块精致的电路板,就只有一条用于供电和下载的USB连接线和两张活页 ...
特权ilove314 2013-8-16 11:27
Nexys3学习手记1:写在前面的话
Nexys3学习手记1:写在前面的话 偶然的机会,结识了xilinx的几位大牛,便毫不客气的从他们的手中接过了基于Spartan-6的由Digilent公司研发的Nexys3开发 ...
特权ilove314 2013-8-16 11:27
Nexys3学习手记4:自检测试
Nexys3学习手记4:自检测试          分析完原理图,干好这项专业活,接下来我们就来点小儿科检验一下板子。话说一块像样量产的电路板都少不了 ...
特权ilove314 2013-8-16 11:27
Nexys3学习手记3:硬件外设走马观花
Nexys3学习手记3:硬件外设走马观花 解读原理图          拿到一块新的电路板,通常我们会很迫不及待先跑个测试Demo看看效果,但请相信 ...
特权ilove314 2013-8-16 11:26
【博客大赛】Nexys3学习手记5:流水灯在线运行
Nexys3学习手记5:流水灯在线运行          在进行第一个工程实例前,顺便提一下设计工具相关资源的获取。从特权同学接触的几家FPGA开发工具来 ...
特权ilove314 2013-8-16 11:26
【博客大赛】Nexys3学习手记7:MicroBlaze小试牛刀(1)
           有了前面两个实例的铺垫,下面这个工程就要带大家尝试搭建一个基于MicroBlaze的应用。特权同学也是第一次接插Xilinx的嵌入式开发平 ...
特权ilove314 2013-8-16 11:25
【博客大赛】Nexys3学习手记8:FT232之高速UART(1)
Nexys3学习手记8:FT232之高速UART          继续上一节的工程,这里要接着在XPS上扩展一个UART外设,配合板载的USB2UART芯片FT232R做个高速串 ...
特权ilove314 2013-8-16 11:25
【博客大赛】Nexys3学习手记7:MicroBlaze小试牛刀(2)
         接着我们来看看Ports部分,如图11所示。这里展开External Ports便是该系统所有需要与外部进行直接隐射的管脚。LEDS_TRI_O便是8个连接到板上 ...
特权ilove314 2013-8-16 11:25
【博客大赛】Nexys3学习手记8:FT232之高速UART(2)
        接下来要看软件的了,打开SDK并定位Workspace到本实例工程的SDK_workspace目录下。我们点击mysoc_hw_platform目录下的system.xml,此时发现并 ...
特权ilove314 2013-8-16 11:24
【博客大赛】Nexys3学习手记6:Clocking
Nexys3学习手记6:Clocking          这一节,我们首先会来了解下Nexys3上的主角儿XC6SLX16(Spartan-6家族)的时钟资源,当然不会照搬ug382.p ...
coyoo 2013-8-15 16:33
【博客大赛】利用SignalTap II调试ALTERA器件一例
调试工具: Altera的SignalTap II 目标器件:Altera的ArriaGX 主要功能模块:Altera的FIFO函数             由于项目中使用到了很 ...
用户441847 2013-8-14 17:11
安装Xilinx Ise13,.2和modelsim se10.1a
今天学习安装Xilinx Ise13,.2和modelsim se10.1a两款软件,Xilinx Ise13,.2挺好安装的,按照步骤来,最后的**也是很简单,但是在modelsim se10.1a的时候,我 ...
sunyzz 2013-8-14 10:51
【博客大赛】Verilog奇数-小数分频
  1、半整数分频占空比不为50% //说明:设计的史上最好用的半整数分频占空比不为50%,包含设计思路 module div_5(clk,clk_div,cnt1,cnt2,te ...
关闭 站长推荐上一条 /3 下一条