FPGA和CPLD-可编程逻辑器件-第382页-面包板社区

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用户254708 2010-3-7 13:38: SOPC入门的第一个程序; 最近学习FPGA的SOPC相关东西，搞了个简单系统，在NIOS-II环境下写了个入门流水灯程序，呵呵，发表发表。 #include "system.h" #include "altera_avalon_pio_r ...; 1455 1 0 1

用户180508 2010-3-7 09:46: IP核从端口寄存器模块设计指南; 寄存器设计包括： 1. 偏移地址， 2. 寄存器名称， 3. 各个位的功能， 4. 读写权限（只读、读写都可以，写后清零） ?xml:namespace prefix = o n ...; 3113 3 2 5

用户264106 2010-3-6 13:32: 李书福委员：应上调个税起征点并推进个税改革; 新华网北京3月2日电（记者南辰、罗宇凡）“为了促进内需的增长，国家有关部门应尽快上调个人所得税起征点并推进个人所得税改革，改善民生，使广大工薪阶层的可支 ...; 700 0 0 0

用户1609127 2010-3-6 12:34: CPLD笔记4 数码管显示; 笔记 4 数码管显示 ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / module lesson04 ( ...; 2602 8 1 9

用户1609127 2010-3-6 12:11: CPLD笔记3 john计数器！流水灯？; 笔记 3 john 计数器！流水灯？ ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / module lesso ...; 2717 7 0 7

用户1609127 2010-3-6 11:59: CPLD笔记2 键盘消抖; 笔记 2 键盘消抖 ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / 老实说，这个实验的开始之前和之后，都给我蛋 ...; 2344 10 2 12

用户1609127 2010-3-6 11:46: CPLD笔记1.5 从逻辑设计到RTL设计转换的蛋疼; 笔记 1.5 从逻辑设计到 RTL 设计转换的蛋疼 ?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / 这一片笔记基本 ...; 2851 8 0 8

ash_riple_768180695 2010-3-5 20:44: 摘抄一组SATA转接卡异常问题的调试记录; 昨天回顾了一下两年前离职时保存的工作日志，读到其中一段调试工作的记录时，仿佛又亲历了三年前那段艰辛的调试经历。解决这个问题用了近两个月 ...; 4418 7 1 8

用户1542249 2010-3-5 14:07: modelsim Testbench FPGA仿真; 来源： http://blog.ednchina.com/liu_xf/431336/message.aspx FPGA调试篇（二）在Modelsim下使用TestBench对设计进行仿真 Signal Tap II ...; 2807 8 0 8

用户1542249 2010-3-5 14:03: SignalTap II FPGA 调试; 来源： http://blog.ednchina.com/liu_xf/422851/message.aspx FPGA调试篇（一）在Quartus下使用SignalTap II 调试FPGA 在一数控系统的项目 ...; 2292 6 0 6

用户1542249 2010-3-5 10:41: what is register packing?; 来源： http://dbaspot.com/forums/arch/253676-what-register-packing.html; 2146 5 0 5

用户1542249 2010-3-5 10:37: 如何分析FPGA的片上资源使用情况; 来源： http://blog.ednchina.com/riple/359264/message.aspx 如何分析FPGA的片上资源使用情况在维护遗留代码（4）——时 ...; 2395 8 0 8

用户180508 2010-3-4 16:41: ModelSim 与Quartus II联合仿真; 系统内有宏模块库的仿真 :?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" / 需要添加库文件，路径 \altera\80 ...; 4379 4 0 4

用户1651241 2010-3-4 15:02: Xilinx FIFO IP core使用注意事项; 1、almost full 和 almost empty flags用来指示只剩一个字了。 2、Programmable full and empty status flags可以由用户自定义内容设定或者用专用的输入口进 ...; 10618 11 0 11

用户258085 2010-3-4 14:05: VT-VSPA2-50-10/T1; 联系人：张小姐直线：027-51778170 传真：027-50167617QQ :810548718 13297919638 VT-VSPA2-50-10/T1 VT-VSPA2-50-10/T5 VT3006-3X VT3000-3X VT11118-1X V ...; 829 3 0 3

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