FPGA和CPLD-可编程逻辑器件-第83页-面包板社区

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洋仔 2015-10-12 16:29: Altera FPGA基本结构; 对于FPGA的学习者而言，怎样学习FPGA是大家争论不断的。有的认为要先学习语言，也就是HDL硬件描述语言；也有的说要先学习数电、模电，没有这些知识，就算学 ...; 2860 28 1 29

fpga cpld le 基本结构

用户413727 2015-10-11 11:47: FPGA输入信号整形处理; FPGA输入信号整形在FPGA的输入信号里经常会有各种毛刺信号，那么一种比较简单的处理方法是进行整形处理，它的思想是： 1、输入信号进行三个时钟周期 ...; 2698 10 0 10

fpga

sunyzz 2015-10-11 11:14: 【博客大赛】基于DE2-115平台的Giga-Ethernet的设计与实现2; 4 、设计架构 1 、千兆以太网 MAC 层硬件结构千兆以太网 MAC 硬件结构大致分为 5 个模块， Avalon Interface 模块主要用于寄 ...; 1805 19 1 20

博客大赛 ethernet

sunyzz 2015-10-10 11:16: 【博客大赛】基于DE2-115平台的Giga-Ethernet的设计与实现; 1 、设计介绍在计算机网络的发展过程中，以太网技术凭借易于组网、性能高等优点而淘汰了诸如令牌环等技术而成为众多网络技术中最具影响力的一种 ...; 1914 17 0 17

博客大赛以太网，千兆以太网

用户1855509 2015-10-9 20:20: 评论：@sunyzz 博客中提到的“【博客大赛】高速uart设计及验证之关键点分析-附参考代码”; 学习了; 697 8 0 8

用户1855509 2015-10-9 20:16: 评论：@sunyzz 博客中提到的“【转】ASIC设计流程”; 了解芯片设计很不错; 757 8 0 8

用户1846087 2015-10-9 08:45: 评论：@小倚危楼听春雨博客中提到的“我的Verilog 代码风格-供参考”; 非常有用; 649 6 0 6

用户1846087 2015-10-9 08:42: 评论：@小倚危楼听春雨博客中提到的“Verilog三段式状态机描述”; 正在学习状态机; 584 5 0 5

特权ilove314 2015-10-8 23:04: 【博客大赛】Xilinx FPGA入门连载11：PWM蜂鸣器驱动之功能概述; Xilinx FPGA 入门连载 0 ：特权同学，版权所有配套例程和更多资料下载链接： http://pan.baidu.com/s/1jGjAhEm 1 ...; 1328 10 0 10

fpga xilinx 博客大赛

用户1835172 2015-10-8 09:20: verilog中浮点数的表示以及浮点数除法IP核的使用; Verilog 中的浮点数的表示以及浮点数除法 IP 核的用法初学 FPGA ，最近用到除法，刚开始想要自己写一段除法 ...; 5277 14 3 17

fpga 浮点数除法ip核

洋仔 2015-10-5 16:05: 基于FPGA的图像采集之二 GEN_FRAME（成帧）模块; 距离上次的博客已经有段时间了，这写些日子一直在调SDRAM的模块以及文档的书写，SDRAM的子模块比较多，包括init（初始化模块）、refresh（刷新模块）、write ...; 1857 29 0 29

fifo 跨时钟域亚稳态

coyoo 2015-9-30 11:13: FPGA设计一书印刷完成了; 千呼万唤始出来; 3836 19 9 28

fpga

洋仔 2015-9-29 15:59: 基于FPGA的图像采集之一 USB2.0; 一 .USB2.0简介 USB2.0协议时一种高速串行的通信协议，它是半双工的，最高传输速率可达480MHZ/s，并且支持热插拔等特点，目前被广泛使用。 ...; 1530 29 0 29

usb2.0 fifo 图像采集三态门

用户211539 2015-9-28 16:21: FPGA采购和技术咨询：3044959554; Altera Xilinx FPGA采购和技术咨询QQ：3044959554; 1350 31 0 31

fpga altera xilinx

洋仔 2015-9-26 22:26: FPGA中你必了解的一些概念; 笔者是应届毕业生，也逃脱不了找工作的命运，从上海至芯风风火火赶回学校，参加某某公司的笔试，下面是某某公司的笔试题，挑出一些概念与简答类型的题目，其 ...; 1218 18 0 18

阻塞，流水线，组合逻辑，时序逻辑

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