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用户452411
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多路时钟选择
问题描述: 程序中需要转换 50MHz 和16MHz 时钟,我直接用一个信号来控制两个时钟的切换,而 这个信号是被 8MHz 时钟同步的。结果就悲剧了。 解决方 ...
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特权ilove314
2015-11-19 23:02
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FPGADeveloper
2015-11-19 17:24
评论:@emesjx's Blog 博客中提到的“高速LVDS接口信号完整性处理实例”
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广州老伯
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2015-11-18 17:47
???阿发
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用户1778378
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cpld
设计
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博客大赛
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特权ilove314
2015-11-17 22:46
Xilinx FPGA入门连载25:PLL实例之模块化设计
Xilinx FPGA 入门连载 25 : PLL 实例之模块化设计 特权同学,版权所有 配套例程和更多资料下载链接: http://pan.baidu.com/s/1jGjA ...
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特权ilove314
2015-11-16 22:30
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用户1827022
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FPGA复位电路设计分析--读bingo书有感
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