FPGA和CPLD-可编程逻辑器件-第78页-面包板社区

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满不在乎 2015-11-18 11:48: 【博客大赛】FPGA与CPLD的区别; FPGA（Field－Programmable Gate Array），即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。它是作为专用集成电路( ...; 4215 13 2 15

fpga cpld 设计编程博客大赛 a

特权ilove314 2015-11-17 22:46: Xilinx FPGA入门连载25：PLL实例之模块化设计; Xilinx FPGA 入门连载 25 ： PLL 实例之模块化设计特权同学，版权所有配套例程和更多资料下载链接： http://pan.baidu.com/s/1jGjA ...; 1496 8 0 8

fpga xilinx

特权ilove314 2015-11-16 22:30: Xilinx FPGA入门连载24：PLL实例之基本配置; Xilinx FPGA 入门连载 24 ： PLL 实例之基本配置特权同学，版权所有配套例程和更多资料下载链接： http://pan.baidu.com/s/1jGjAhE ...; 2165 12 0 12

fpga xilinx

用户1827022 2015-11-15 12:35: FPGA复位电路设计分析--读bingo书有感; 从开始学FPGA一直想写博客，记录自己的FPGA学习过程，二是对学的知识进行巩固，后来才发现并不是那么容易的事情，学过一段时间有一定领悟之后敢去写， ...; 637 4 0 4

复位电路的设计

洋仔 2015-11-15 09:21: 千兆以太网; 一.什么是以太网以太网是当今居于主导地位的局域网技术。它不是一种具体的网络，而是一种技术规范。以太网是建立在CSMA/CD（带冲突检测的载波侦听 ...; 1711 22 0 22

crc phy 千兆以太网回环测试

用户450531 2015-11-13 22:54: [整理]FPGA编码规范; 规范编码，越早越好—— 开始FPGA学习的准备—— FPGA 编码规范，下面内容来自网络资料 1. 遵循代码编写规 ...; 1097 21 0 21

fpga

阿昏豆 2015-11-9 22:25: 平行宇宙的追逐--异步FIFO控制器的设计; 平行宇宙的追逐--异步FIFO控制器的设计。在逻辑设计中，通常会用到异步FIFO，异步FIFO控制器是经典的异步信号传输的范例，通过FIFO控制器 ...; 2690 13 1 14

ip设计异步fifo控制器

T.b.K 2015-11-9 14:12: 初学FPGA，怎么从硬件上理解？; 先理解组合逻辑和时序逻辑，后面就好说了，这里先讲讲狭义的组合逻辑和时序逻辑，时序逻辑一般指的是D触发器，组合逻辑指的是：与门或门非门，比较器，选择 ...; 6950 17 10 27

fpga

用户1847167 2015-11-9 10:16: Verilog代码的编写流程; 四个步骤：头文件、接口描述（信号列表的定制）、逻辑功能的描述、编译。步骤如下： 1.头文件：笔者现在未感觉到头文件的重要性，所以在此先省去。 2.接口描 ...; 1046 2 1 3

verilog、编写流程、入门

用户1847167 2015-11-9 09:47: Modelsim的基本使用流程(没法再省的步骤); 由于不方便在此编辑模式下发图片，所以把文章上传到百度文库中，链接如下： http://wenku.baidu.com/view/7beed382192e45361166f56f ...; 976 1 0 1

modelsim、fpga、入门

特权ilove314 2015-11-8 22:05: Xilinx FPGA入门连载23：PLL实例之功能简介; Xilinx FPGA 入门连载 23 ： PLL 实例之功能简介特权同学，版权所有配套例程和更多资料下载链接： http://pan.baidu.com/s/1jGjAh ...; 2136 17 0 17

fpga xilinx

广州老伯 2015-11-7 23:51: FPGA学习笔记5——VGA驱动; VGA驱动 VGA接口是一个常用到的接口，今天笔者带大家来探讨下怎么样编写VGA驱动。从数据手册上我们可以看到VGA接口一共有15个引脚，但其实真正需要 ...; 2561 14 5 19

fpga 博客大赛

用户1860823 2015-11-6 10:29: (多图) FPGA开发流程：详述每一环节的物理含义和实现目标; 要知道，要把一件事情做好，不管是做哪们技术还是办什么手续，明白这个事情的流程非常关键，它决定了这件事情的顺利进行与否。同样，我们学习FPGA开发数字系统这 ...; 1203 26 0 26

开发流程 FPGA 约束静态时序

广州老伯 2015-11-5 21:24: FPGA学习笔记4——PLL的IP核使用; PLL的IP核使用 PLL锁相环的IP核应该是在FPGA开发中用得最多的一个模块了，下面介绍如何使用PLL的IP核。首先，我们新建一个工程，新建一个verilog文件，保 ...; 3264 15 0 15

fpga 博客大赛

特权ilove314 2015-11-5 21:20: Xilinx FPGA入门连载22：经典模式流水灯实验; Xilinx FPGA 入门连载 22 ：经典模式流水灯实验特权同学，版权所有配套例程和更多资料下载链接： http://pan.baidu.com/s/1jGjAhEm ...; 1361 13 3 16

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