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FPGA/CPLD
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FPGA/CPLD
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用户1831126
2015-12-14 13:47
VGA练习之图像的动态显示(后续)
代码部分: /* 分辨率:600*480 功能:每隔3s变化一次,a~e循环变换 a.全红 b.全白 c.2*2 4部分,分别是:红,蓝,绿,黄 ...
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fpga
博客大赛
vga
用户468979
2015-12-14 10:22
评论:@阿昏豆 博客中提到的“把大象关冰箱的步骤 --- NAND FLASH控制器磨损管理算法...”
看来还是NorFlash比较简单啊
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用户1122702
2015-12-13 22:23
可综合的SystemVerilog:命名空间
关键名词解释: 编译单元(compilation unit):SystemVerilog 源代码的集合 编译单元域(compilation-unit scope):即编译单元的本地 ...
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systemverilog
命名空间
用户1122702
2015-12-13 22:15
可综合的SystemVerilog:参数化函数/任务
在Verilog中,参数化模块被广泛应用。参数可重新定义保证模块的可配置性及可复用性。但是,函数及任务并无法像模块一样被参数化,减弱了Verilog的描述化 ...
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systemverilog
参数
函数
特权ilove314
2015-12-13 19:26
Xilinx FPGA入门连载36:倒车雷达实例之设计说明
Xilinx FPGA 入门连载 36 :倒车雷达实例之设计说明 特权同学,版权所有 配套例程和更多资料下载链接: http://pan.baidu.com/s/1jGjAh ...
2003
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fpga
xilinx
用户1831126
2015-12-13 14:27
16位计数器之元件例化的学习
16位全加器 通过该实验,学习 元件例化 。 1个16位全加器由4个4位全加器构成; 1个4位全加器由4个1位全加器构成; 1位全加 ...
1739
9
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fpga
博客大赛
用户1856144
2015-12-13 10:06
FIFO 同步、异步以及Verilog代码实现
FIFO 很重要,之前参加的各类电子公司的逻辑设计的笔试几乎都会考到。 FIFO是英文First In First Out 的缩写,是一种先进先出的数据缓存器,他与普 ...
728
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verilog
用户436812
2015-12-12 01:21
评论:@visionary 博客中提到的“关于Quartus和ISE中ROM的初始化和仿真的一些小结”
ISE的仿真与quartus差不多,注意下细节
776
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特权ilove314
2015-12-10 21:28
Xilinx FPGA入门连载35:倒车雷达实例之功能简介
Xilinx FPGA 入门连载 35 :倒车雷达实例之功能简介 特权同学,版权所有 配套例程和更多资料下载链接: http://pan.baidu.com/s/1jGjA ...
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fpga
xilinx
用户1853499
2015-12-10 15:18
明德扬点拨FPGA高手进阶--第一章软件介绍及安装-1. Quartus II
1.1 Quartus II介绍 Quartus II是Altera公司的综合性PLD/FPGA开发软件,原理图、VHDL、Verilog HDL以及AHDL(Altera Hardware支持Description Language) ...
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fpga
quartus
明德扬
用户284633
2015-12-10 12:19
开篇
在阅读一个FPGA书的时候,看到了末尾的一篇博文,提到了ricky su,随手在lync上查了一下,找到了。 前任老板在我走的时候说,技术方面不用钻太深, ...
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fpga
序
用户1816300
2015-12-9 22:31
走自己的路,不断前行
一直以来,在大学学习单片机和ARM相关技术,然后到硕士阶段进行FPGA的研究学习,有不懂的地方都会上网查找解决问题的方法,并得到很多人的无私帮 ...
900
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fpga
用户446166
2015-12-8 19:47
CycloneIV的上电之AS配置
最早看到相关的知识是在coyoo的博客上看见的 控制FPGA上电、配置以及初始化时 http://bbs.ednchina.com/BLOG_ARTICLE_276249.HTM , ...
2558
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用户1861642
2015-12-8 18:58
评论:@专注的力量 博客中提到的“fpga学习日记17,第一个综合项目数字时钟”
有用
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用户1861642
2015-12-8 17:51
评论:@雷的博客 博客中提到的“(多图) 出租车计价器的FPGA设计”
对实训有帮助
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