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用户442508
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用户442508
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Verilog-FPGA 硬件电路设计之二 ——if 语句 和 case 语句的区别 一个 if 语句中嵌套了 case 语句的例子,可以很好的看出 if 语句和 case 语句 ...
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用户442508
2013-10-18 09:56
[博客大赛]Verilog-FPGA硬件电路设计之三——关于迟滞信号
Verilog-FPGA 硬件电路设计之三——关于迟滞信号 在条件选择语句中,由于信号的处理存在时间上的差异,从前级传递到下级的数据就存在到达时间 ...
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迟滞信号处理
用户442508
2013-10-18 09:56
[博客大赛]Verilog-FPGA硬件电路设计四——最大公约数功能仿真和时序仿真区别
综合软件 :QuartusII 12.1 仿真软件 :Modelsim-Altera 1 、输出 done 无寄存器 , 直接从组合逻辑电路输出 1.1 功能仿真 ...
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最大公约数
用户442508
2013-10-18 09:55
Verilog-FPGA硬件电路设计之五——脉动矩阵计算FIR
脉动阵列( Systolic Array )计算有限冲激响应( FIR ) 综合软件 :QuartusII 12.1 仿真软件 :Modelsim-Altera FIR :有限脉冲响 ...
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用户442508
2013-10-18 09:55
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脉动阵列( Systolic Array )计算矩阵乘法( Array Multiplication ) 下一个目标是实现流水线输出,提升硬件资源的利用率。 脉动 ...
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路径切换
用户442508
2013-10-18 09:54
Verilog-FPGA硬件电路设计之七——矩阵乘法流水线结构
二维流水线结构矩阵乘法( Array Multiplication ) 上一篇文中建立了矩阵乘法运算的数据路径,从仿真结构中可以看出整个计算方案的可行性, ...
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矩阵乘法
流水线
用户442508
2013-10-18 09:54
[博客大赛]Verilog-FPGA硬件电路设计之一——if语句优先级
Verilog-FPGA 硬件电路设计之一 ——if 语句优先级 综合软件: Quartus II 一、有优先级的 if 语句 if..else if.. else if ...
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if语句
用户442508
2013-10-18 09:53
基于FPGA的数字滤波设计—系统需求
数字滤波设计 — 系统需求 1 、系统需求 1.1 系统架构 三片 ADS8320 控制 72 路 AD 通道,每片 AD 器件通过 ...
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用户442508
2013-10-18 09:53
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用户442508
2013-10-18 09:52
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用户442508
2013-10-18 09:52
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2.1.4 滤波器的选择 前面已经介绍了 IIR 和 FIR 数字滤波器的基本理论,选择哪一种滤波器取决于每种类型滤波器的优点在设计中的重要性 ...
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用户442508
2013-10-18 09:51
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2.2 多采样率处理(信号的抽取与插值) 本设计中,从 1K 的采样序列中,输出 512 、 256 、 128 采样序列时,需要做抽取操作。信 ...
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用户442508
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