FPGA/CPLD
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用户837343 2010-6-12 14:37
基础篇:第一章 FPGA/CPLD简介
涵盖了所有altera主流的FPGA/CPLD硬件结构与特点,详尽讨论了Quartus II与第三方EDA工具的设计方法,系统阐述了altera可编程设计优化技术。 第一章 FPGA/ ...
用户837343 2010-6-12 14:37
基础篇:第二章 Altera FPGA/CPLD 的结构
第 2 章 Altera FPGA/CPLD 的结构 FPGA 早已不仅仅是传统意义上的通用可编程逻辑,而是越来越像一个可编程的片上系统。 可编程 ...
用户837343 2010-6-12 14:37
基础篇:第三章altera Quartus II开发流程
第3章 altera Quartus II开发流程 设计步骤:           设计输入----design entry              可使用Assignment Edit ...
用户837343 2010-6-12 14:36
基础篇:第四章 altera 的IP工具
第四章 altera的IP工具 altera的IP核的安装文件可以在 www.altera.com 网站上免费下载到。 注:在定制从网上下载的IP功能模块时,需要制定IP库的位 ...
用户837343 2010-6-12 14:36
基础篇:第五章 Quartus II常用辅助设计工具
第五章:Quartus II常用辅助设计工具 包括I/O分配验证工具、功率估计和分析工具、RTL阅读器、signalProbe(信号探针)及SignalTap II逻辑分析仪、Chip E ...
用户1546193 2010-6-12 14:31
后端设计流程
后端 设计 流程 ASIC/SoC后端设计作业流程剖析 Toshiba(美国)    秦晓凌 Trident( 上海 )    潘中平 关键词 place route DSM ...
用户230340 2010-6-11 23:51
阻塞与非阻塞( block & non-block)
阻塞与非阻塞( block non-block) 两种赋值方法,区别如下: Block: “=”,阻塞即阻塞后面的赋值语句进行,直到该句计算完RHS,并赋给LHS.计算RHS期间不允 ...
fuxiao123_401762695 2010-6-11 14:58
回答Chipscope的一些问题
转: http://www.openhw.org/walkie/blog/10-06/191216_cec6e.html 今天被问到了一些chipscope,想应该是比较基础,比较普遍的问题,于是记录下来了。 ...
用户1483346 2010-6-10 13:15
深入浅出玩转FPGA视频学习课程 [精华][转]
深入浅出玩转FPGA视频学习课程   文章发表于:2009-11-11 15:28 ?xml:namespace prefix = o / 特权同学准备录制一套为期 35 课的 FPGA ...
用户193724 2010-6-10 08:09
异步FIFO为什么要使用格雷码(摘)
异步FIFO为什么要使用格雷码(摘) (2009-07-26 08:56:26) 转载 标签: it 分类: IC技术文章 首先要了解 ...
用户230340 2010-6-9 22:43
altera 常用脚本命令
测试板子或程序时,如果很多,很重复, 可以做几个脚本文件,打开command shell,执行脚本就可以. 比如 test.sh command shell 下执行 $ ./test.sh 即可. ...
fuxiao123_401762695 2010-6-8 21:58
让没有晶振的生活成为可能——UFM.[CPLD]
http://www.cnblogs.com/crazybingo/archive/2010/05/14/1735338.html 一、 简 介 传闻说CPLD有个缺陷,就是内部没有存储模块,所以不能对RAM,ROM等操作 ...
用户234619 2010-6-8 16:59
串口接收最小系统
1 提出 最小系统的概念已经很久了。这里赋予的内涵是从功能上来讲的:通过串口接收一个数据,然后将其并行输出。之所以叫最小系统,是因为它涵盖了串口 ...
用户180508 2010-6-8 14:29
$monitor任务调用要领
只要参变量值发生变化,就在过程块结束时,打印列表。 一般使用时一个监控任务 监视多个参数 。 任何时刻只能有一个监控任务处于激活状态,下面的例子调用 ...
用户180508 2010-6-8 10:37
3分频——不可综合
思路: 第一步:将原始时钟6分频。 第二步:将6分频后的时钟相移1/4周期 第三步:6分频时钟与相移后时钟异或得到3分频时钟。 module dive_3;     re ...
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