FPGA/CPLD
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coyoo 2015-8-21 08:56
有关ALTCLKCTRL模块的一些变化
新书的逻辑内生时钟一章特别讲到了altera的ALTCLKCTRL模块,使用过这个模块的都知道,其四个输入是有限制,即四个输入中最多只能有两个来自fpga的引脚,且四 ...
特权ilove314 2015-8-19 18:20
【博客大赛】FPGA实战演练逻辑篇65:CMOS摄像头接口时序设计5时序报告
CMOS 摄像头接口时序设计 5 时序报告 (特权同学版权所有) 本文节选自特权同学的图书《 FPGA 设计实战演练(逻辑篇)》 (特权同 ...
特权ilove314 2015-8-18 20:51
【博客大赛】FPGA实战演练逻辑篇64:CMOS摄像头接口时序设计4时序约束
CMOS 摄像头接口时序设计 4 时序约束 (特权同学版权所有) 本文节选自特权同学的图书《 FPGA 设计实战演练(逻辑篇)》 (特权同 ...
用户1847764 2015-8-17 22:15
FPGA学习心得------------计数器的显示
这是昨天刚刚做完的一个,小项目主要是为了练习按键消抖、数码管显示、二进制转bcd码的练习。刚开始学习FPGA,所以没事就总结一下自己的学习过程,如有不对 ...
用户1664191 2015-8-17 11:13
7系列FPGA管脚说明
Zynq7000 系列之Zynq7000系列引脚功能综述 很多人做了很久的FPGA,知道怎么去给信号分配引脚,却对这些引脚的功能及其资源限制知之甚少;在第一章里对 ...
特权ilove314 2015-8-17 08:16
【博客大赛】FPGA实战演练逻辑篇63:CMOS摄像头接口时序设计3实际计算
CMOS 摄像头接口时序设计 3 实际计算 (特权同学版权所有) 本文节选自特权同学的图书《 FPGA 设计实战演练(逻辑篇)》 (特权同 ...
用户590108 2015-8-16 21:04
时序约束的几种方法
对自己的设计的实现方式越了解,对自己的设计的时序要求越了解,对目标器件的资源分布和结构越了解,对EDA工具执行约束的效果越了解,那么对设计的时序约束目 ...
用户590108 2015-8-16 12:00
【转】信号去直流方法
  利用FPGA进行数字信号处理时,信号中的直流分量通常需要去除,而直流分量在AD前段就存在,如果采用模拟电路去除直流分量比较复杂,因此通常在AD后端数字域 ...
用户590108 2015-8-16 11:39
DSP in FPGA:FIR滤波器(五)
     在DSP in FPGA: FIR滤波器设计(二)、(三)、(四)中分别讲解了直接型、转置型和脉动型结构FIR滤波器的实现方法,这三种结构是FPGA实现中比较常用 ...
用户590108 2015-8-16 11:37
DSP in FPGA:FIR滤波器(四)
这节主要讲解脉动型(Systolic)FIR滤波器设计。          脉动型FIR滤波器是对直接型的升级,在每个操作后都加入流水线级,每个动作都打一拍,就 ...
用户590108 2015-8-16 11:36
DSP in FPGA:FIR滤波器(三)
这一节主要讲解一下转置型FIR滤波器实现。          FIR滤波器的单位冲激响应h(n)可以表示为如下式:          对应转置型结 ...
用户590108 2015-8-16 11:32
DSP in FPGA:FIR滤波器(二)
  FIR滤波器根据输入数据速率的不同可分为串行结构、半并行结构和全并行结构。串行结构的FIR滤波器是将并行数据串行输入,所需的DSP资源较少,但是数据吞吐 ...
用户590108 2015-8-16 11:13
【转载】DSP in FPGA:FIR滤波器(一)
FIR滤波器广泛应用于数字信号处理中,主要功能就是将不感兴趣的信号滤除,留下有用信号。FIR滤波器是全零点结构,系统永远稳定;并且具有线性相位的特征,在 ...
特权ilove314 2015-8-14 07:16
【博客大赛】FPGA实战演练逻辑篇62:CMOS摄像头接口时序设计2实际分析
CMOS 摄像头接口时序设计 2 实际分析 (特权同学版权所有) 本文节选自特权同学的图书《 FPGA 设计实战演练(逻辑篇)》 (特权同 ...
用户1829338 2015-8-13 14:56
(多图) FPGA基础知识及其工作原理
高端设计工具为少有甚是没有硬件设计技术的工程师和科学家提供现场可编程门阵列(FPGA)。无论你使用图形化设计程序,ANSI C语言还是VHDL语言,如此复杂的合成工艺 ...
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