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快速学会7-kiCad-9分钟学会手工创建封装.rar
所需E币:5
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大小:28.03MB
时间:2025.06.03
上传者:电子阔少
快速学会经典KiCad-9分钟学会绘制原理图.rar,KiCad视频讲座,PCB,设计电路图,画电路图,电路板,绘制电路图,原理图,PCB设计软件
kicad
pcb
设计电路图
画电路图
电路板
绘制电路图
原理图
PCB设计软件
快速学会6-Ki
c
ad-9分钟学会封装向导.rar
所需E币:5
下载:0
大小:25.35MB
时间:2025.06.03
上传者:电子阔少
快速学会经典KiCad-9分钟学会绘制原理图.rar,KiCad视频讲座,PCB,设计电路图,画电路图,电路板,绘制电路图,原理图,PCB设计软件
快速
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6Kicad9
钟学会
封装
rar
Linux 命令和 C语言知识
所需E币:5
下载:0
大小:191.65KB
时间:2021.03.18
上传者:samewell
Linux命令和C语言知识1.用户命令useradd用户名//添加用户userdel用户名//删除用户passwd用户名//设置密码whosu-用户名(或者su用户名)前者切换变量、后者不切换变量//
linux
命令
语言
知识
[华为]C语言编程规范总则
所需E币:5
下载:0
大小:67.48KB
时间:2020.12.02
上传者:kaidi2003
[华为]C语言编程规范总则
华为
语言编程
规范
华为C语言编程规范总则
所需E币:5
下载:0
大小:45.67KB
时间:2020.12.02
上传者:kaidi2003
华为C语言编程规范总则
华为
语言编程
规范
从虚拟原型到运行功率分析,系统学习En
c
ounter
所需E币:4
下载:0
大小:2.08MB
时间:2020.11.19
上传者:xgp416
从虚拟原型到运行功率分析,系统学习En
c
ounter资源大小:2.08MB[摘要]计划一个设计并创建一个虚拟原型平面布置图设计创建分层分区和时间预算用阿米巴放置器在设计中放置块和标准细胞。试运行线路和
虚拟原型
运行
功率分析
系统
学习
encounter
无线充电发射端控制SoC芯片IP6808
所需E币:4
下载:1
大小:2.1MB
时间:2020.11.19
上传者:xgp416
无线充电发射端控制SoC芯片IP6808资源大小:2.1MB[摘要]IP6808是一款无线充电发射端控制SoC芯片,兼容WPCQiv1.2.4最新标准,支持A11线圈,支持5W、苹果7.5W、三星10
无线充电
发射
控制
SoC
芯片
IP6808
3D IC堆叠技术
所需E币:4
下载:0
大小:13.29MB
时间:2020.11.19
上传者:xgp416
3DIC堆叠技术资源大小:13.29MB[摘要]前言个人电脑、手机、音乐播放器、游戏系统、相机和flash媒体等消费需求强劲,推动了电子系统市场的爆炸性增长。这些电子系统的设计和制造是通过将单个集成电
3d
ic
堆叠技术
En
c
ounter使用说明.zip
所需E币:5
下载:0
大小:11.16MB
时间:2020.11.19
上传者:xgp416
En
c
ounter使用说明资源大小:11.16MB[摘要]以一32位流水线加法器设计为例,需要的文件包括:综合后的网表netlist.v。综合后的约束文件netlist.sd
c
,注意需要将该文件中的端
encounter
使用
说明
Zip
一文了解综合与Design Compiler
所需E币:4
下载:0
大小:3.62MB
时间:2020.11.18
上传者:xgp416
一文了解综合与DesignCompiler资源大小:3.62MB[摘要]综合是前端模块设计中的重要步骤之一,综合的过程是将行为描述的电路、RTL级的电路转换到门级的过程;DesignCompiler是
一文
解综
Design
compiler
Caden
c
e NC Verilog仿真教程
所需E币:4
下载:3
大小:968.16KB
时间:2020.11.18
上传者:xgp416
Caden
c
eNCVerilog仿真教程资源大小:968.16KB[摘要]这个手册将向你介绍使用NC-Verilogsimulator和SimVision。本文使用的是一个用Veilog硬件编程语言编
cadence
nc
verilog
仿真
教程
Linux 设计SOC的一些基础知识分享
所需E币:4
下载:0
大小:2.37MB
时间:2020.11.18
上传者:xgp416
Linux设计SOC的一些基础知识分享资源大小:2.37MB[摘要]事实上,大多数(如果不是所有)开源应用程序通常都是在诸如ema
c
s(受人尊敬的用户环境和程序编辑器)、g
c
c
(官方GNUC编译器)和
linux
设计
SoC
一些
基础
知识分享
AHB总线上CAN控制器的实现
所需E币:4
下载:0
大小:2.52MB
时间:2020.11.18
上传者:xgp416
AHB总线上CAN控制器的实现资源大小:2.52MB[摘要]CAN总线是一种广泛应用于汽车自动化和工业过程控制领域的现场总线,AHB总线则是一种广泛应用于嵌入式系统的系统总线。本论文介绍了CAN规范和
ahb
总线
can
控制器
实现
RS编解码器的SOC集成设计和验证
所需E币:4
下载:1
大小:2.11MB
时间:2020.11.18
上传者:xgp416
RS编解码器的SOC集成设计和验证资源大小:2.11MB[摘要]现代社会已经进入数字信息化的时代,保证信息的准确性和可靠性异常重要。纠错码是提高信息传输可靠性的一种重要手段,Rs码是一种典型的纠错码,
rs
编解码器
SoC
集成
设计和验证
国外en
c
ounter7.1培训教程
所需E币:4
下载:0
大小:1.26MB
时间:2020.11.18
上传者:xgp416
国外en
c
ounter7.1培训教程资源大小:1.26MB[摘要]与VLSI课程中的其他练习不同,后端设计流要求您学习如何使用一个商业电子设计自动化(EDA)工具,在我们的案例中遇到了Caden
c
e设
国外
encounter71
培训教程
关于Caden
c
e 版图 Virtuoso Simulation
所需E币:5
下载:10
大小:4.8MB
时间:2020.11.18
上传者:xgp416
关于Caden
c
e版图VirtuosoSimulation资源大小:4.8MB[摘要]接下来,选择刚才在库管理器中创建的库,并选择File->New->单元格视图…我们将创建一个逆变电池的
关于
cadence
版图
virtuoso
simulation
A
c
c
ellera标准文件 system verilog资料
所需E币:4
下载:3
大小:4.05MB
时间:2020.11.18
上传者:xgp416
A
c
c
ellera标准文件systemverilog资料资源大小:4.05MB[摘要]A
c
c
ellera标准文件是在A
c
c
ellera内部开发的,A
c
c
elleraorganization,In
c
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