FPGA和CPLD-可编程逻辑器件-第206页-面包板社区

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用户428493 2012-12-12 09:57: fpga仿真工具下载modelsim synplify; ModelSim. Se 6.2b /10.1a软件下载地址： http://l2.yunpan.cn/lk/QM2vsSHjGrX4V Synplify Pro 9.6.2 软件下载地址： http://l2.yun ...; 1575 17 0 17

modelsim synplify 下载 fpga仿真

coyoo 2012-12-12 09:53: 基于FPGA的TDC设计测试结果; 基于ALTERA的FPGA的TDC设计调试已经告一段落，测试结果比较满意，附图是最新的测试结果：需要总结的内容很多，有时间再慢慢总结。 ...; 3766 21 4 25

fpga tdc

用户432484 2012-12-11 20:01: EP4CE10开发板; 核心板说明： FPGA 主芯片采用Altera 公司高性价比FPGA：CycloneIV 系列EP4CE10； •板载EPCS4N 串行配置芯片，同时支持JTAG 和AS 模式； FPGA芯片所 ...; 3125 2 1 3

fpga

telantan_858289931 2012-12-10 20:32: Zedboard: iperf的移植与测试; Zedboard: iperf 的移植与测试 iperf 是一个常用的网络性能测试工具，本文主要介绍 iperf 的移植的过程，最终简单利用 iperf 测试 Zedboa ...; 1876 17 0 17

zynq iperf

用户1522325 2012-12-8 20:57: Altera FPGA 不用管脚处理方式; 使用的Altera FPGA（EP2C8Q208C8N）开发板测试一个小程序：使用Verilog语言实现按键控制LED的亮灭。程序如下： module LED_Verilog（key,led） ...; 750 2 0 2

fpga altera ep2c8q208c8n

用户430136 2012-12-7 11:29: Cyclone III中LVDS的设计; 一，概述 LVDS低压差分信号，最早由美国国家半导体公司提出的一种高速串行信号传输电平，由于它传输速度快，功耗低，抗干扰能力强 ...; 2288 10 0 10

fpga

用户1429847 2012-12-7 10:57: Quartus综合有符号数乘加运算的一个问题; 昨晚项目调试的时候遇到一个问题：输入 IQ 交织、有符号的复信号，时序是： iq_data ： I Q I Q I ...; 5057 21 1 22

fpga verilog 有符号数相乘相加

用户1614717 2012-12-6 10:45: QuartusII使用技巧; 概述：总结一些使用QuartusII软件的小经验，有些技巧性的东西很久不用或者不是经常用到很容易就忘掉，等到用到再到处查 ...; 2811 26 0 26

fpga

用户1614717 2012-12-6 10:43: 学习Debussy，并与ModelSim交互体验; 一、概述初次接触Debussy，在网上搜索了一些资料，发现Debussy的使用者并不多，edacn的论坛Modelsim主论坛中有个Debussy的子 ...; 1711 15 0 15

fpga modelsim debussy

用户1614717 2012-12-6 10:39: 使用QII中的PowerPlay Power Analyzer估算FPGA功耗; 概述 Altera提供了早期FPGA设计功耗估算工具-EPE，当设计基本完成时候，Altera的设计软件QuartusII提供PowerPlay Power Anal ...; 2264 19 0 19

fpga 功耗计算

用户1614717 2012-12-6 10:34: 怎么样将FPGA工程设计加密转移传输; 有个在研究所的朋友（做雷达的）有个项目要跟另外一个研究所合作，也就是共同在同一块FPGA上进行开发，各自设计功能模块都很独立，向我询问如何将他的 ...; 1361 19 0 19

fpga设计加密

用户1614717 2012-12-6 10:33: 怎么样将FPGA工程设计加密转移传输; 有个在研究所的朋友（做雷达的）有个项目要跟另外一个研究所合作，也就是共同在同一块FPGA上进行开发，各自设计功能模块都很独立，向我询问如何将他的 ...; 1195 16 0 16

fpga设计加密

用户1614717 2012-12-6 10:20: 第一个有点用处的Tcl/Tk脚本-MIF生成器; 项目中用到了ROM，rom的大小深度4096，数据宽度21bit，存储的是0到4095的倒数，一开始利用exel表生成这些倒数，今天试试用TCL写了个程序也实现了此功 ...; 1352 15 0 15

tcl mif文件生成

用户427466 2012-12-6 07:58: 那些年，我们拿下了FPGA-第11章循环语句笔记(2); 11.1.3 有限的while 我们有了定数的循环和永远的循环，貌似还是少了什么，当我们需要在一定条件下实现有限的循环的时候，又怎么办呢？Verilo ...; 5921 18 0 18

fpga altera verilog xilinx 循环语句

用户1265970 2012-12-5 16:35: microblaze 使用lwip协议栈的一点体会; 有个项目要用以太网传大量数据，spartan6+ddr3+千兆以太网，内核采用microblaze软核，逻辑搭mac，phy芯片用的88E1111。最开始采用xilinx官方的例子XAPP1 ...; 5013 23 3 26

microblaze lwip 千兆以太网

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