FPGA和CPLD-可编程逻辑器件-第297页-面包板社区

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用户575829 2010-12-5 15:37: [转]Quartus II 10.0调用ModelSim-Altera 6.5e; 1.Altera官网下载两款软件并安装 2.指定ModelSim-Altera 6.5e的安装路径。打开Quartus II 10.0软件，新建工程和文件并保存，然后在菜单栏选择 tools- ...; 3252 10 0 10

用户1500115 2010-12-3 15:29: 【转】两段式和三段式Verilog状态机; 三段式状态机：时序电路的状态是一个状态变量集合，这些状态变量在任意时刻的值都包含了为确定电路的未来行为而必需考虑的所有历史信息。状态机采用Ver ...; 10749 4 0 4

特权ilove314 2010-12-3 14:15: 特权和你一起学NIOS2 第五章实战演练之时序收敛 part11; 3205 9 0 9

用户608696 2010-12-3 12:03: VHDL电子时钟程序; 最近收到网上朋友们来信咨询如何设计电子时钟，也有很多热心朋友把他设计的时钟或时钟程序发给我。因时间和水平有限不能一一回复和审查到底哪些是合格或是网络 ...; 1000 0 1 1

用户1278632 2010-12-2 17:58: ucf 约束; 之前一直相不明白，为什么从官网下载的AC97的IP不能跑起来，整个IP就像空壳一样，bit_clk输进去，没有任何信号输出来。从IP的RTL来看，即使是IP不连到CPU的BUS ...; 6981 7 0 7

用户317928 2010-12-1 19:08: 2009rili.cn; 泰波波太百 ...; 706 0 0 0

用户398287 2010-12-1 16:14: 可编程模拟器件原理与开发; 可编程模拟器件原理与开发可编程模拟器件（Programmable Analog Device）是近年来崭露头角的一类新型集成电路。它既属于模拟集成电路，又同可编程 ...; 886 1 0 1

特权ilove314 2010-11-29 18:32: 特权和你一起学NIOS2 第五章实战演练之时序收敛 part10; 3440 7 0 7

用户309047 2010-11-29 16:42: Can't resolve multiple constant drivers for net **; Can't resolve multiple constant drivers for net ** 这种错误一般是由于定义的reg寄存器在多个always中进行赋值。 always是并行执行的，在多个always中 ...; 6319 5 1 6

用户1500115 2010-11-29 10:34: 如何编写testbench的总结（非常实用的总结）; 1．激励的设置相应于被测试模块的输入激励设置为reg型，输出相应设置为wire类型，双向端口inout在测试中需要进行处理。方法1：为双向端口设置中间变量in ...; 1823 4 0 4

用户319872 2010-11-28 19:06: 偶遇; 早上起床把图书馆开放时间搞忘了，白跑了一趟，冷啊！下午14:30准时到图书馆，去的时候已排起长队，没等几分钟，进中文新书阅览室，借阅区往往借不到好书，所以 ...; 875 1 1 2

用户282447 2010-11-27 18:58: tft verilog驱动; 使用的TFT为群创7寸液晶屏AT070TN83,分辨率为800*480FPGA为ep1c6q240c8，晶振为50M 首先介绍一下TFT接口 1和2脚VL ...; 6735 10 2 12

用户1278632 2010-11-27 13:27: EDK下chipscope的使用; 前言 Chipscope是xilinx公司的嵌入式逻辑分析仪，和Altera的signal tap II一样，是一种通过JTAG接口探测FPGA内部信号的工具，比起外部逻辑分析仪，它用起来更 ...; 5554 13 0 13

真大虫无双 2010-11-27 13:02: 【原创】怎么在NIOS中快速定位找到宏定义的声明位置？; 先引用一下这位仁兄的日志：源地址： http://maozheng11.blog.hexun.com/42962227_d.html --------------原------------------文----------------------- ...; 3446 13 0 13

huotingtu_505472073 2010-11-26 13:04: 【转】VHDL设计中电路简化问题的探讨; 近年来，随着集成电路技术的发展，用传统的方法进行芯片或系统设计已不能满足要求，迫切需要提高设计效率。在这样的技术背景下，能大大降低设计难度的VHDL设计方 ...; 1369 7 0 7

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