FPGA和CPLD-可编程逻辑器件-第125页-面包板社区

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用户446166 2014-10-9 16:27: cyclone ii的M4K应用; 无意中看到compilation report-filter ram summary，看到了M4K的使用情况，工程里用到了4个fifo，两块ram， 256*8,256*24, ...; 1798 18 0 18

fpga altera fifo m4k

用户872149 2014-10-7 23:54: 评论：@wdzfd's Blog 博客中提到的“一位工程师的FPGA项目开发经验总结”; FPGA; 733 12 0 12

用户1779936 2014-10-3 10:56: 评论：@一点一滴到永恒博客中提到的“FPGA代码分析之手动建立模块连接图”; 学习至上; 698 12 0 12

用户1736014 2014-9-29 22:14: 仿真利器——SignalTap的波形导出功能; 最近在做视频解码的项目，遇到一个难题，BT656解码模块写好后，想仿真看看功能是否正确，发现更本无从下手。原因是整个解码模块只有两个输入 ...; 1340 4 1 5

模拟数据仿真模块 a

用户1777143 2014-9-29 16:28: cypress usb generic driver安装; 对于usb刚刚开始接触，之前一直蛮抵制的，usb（you are sb）O(∩_∩)O哈哈~ 今天装驱动的时候遇到不少问题，首先是跟更改驱动文件，然后装好后win764位 ...; 1525 11 0 11

usb

用户36690 2014-9-29 09:36: 高速LVDS接口信号完整性处理实例; 一、系统介绍 EMCCD相机由图像传感器、驱动电路、FPGA（Spartan-3）、LVDS接口和电源等组成。LVDS输出接口使用2片DS92LV1021，每片实现10bit并行 ...; 2995 27 0 27

fpga lvds 信号完整性驱动电流

用户1664191 2014-9-28 18:18: XILINX 7系列FPGA简介; 简单介绍了7系列FPGA的特点，对于选型可看一下; 756 9 0 9

7系列fpga简介

用户1664191 2014-9-28 15:57: Virtex-6 Clocking Resources 笔记; 全局时钟：每个V6器件有32个全局时钟线（global clock line），全局时钟线只能被BUFG驱动。其中只有12个全局时钟线能用到同一个时钟区域。全局时钟 ...; 709 2 0 2

用户415513 2014-9-26 15:38: FPGA编程对资源的影响; FPGA编程对资源的影响本文以cycloneIV为例说明，以下编程均基于EP4CE15F17C8芯片。一、多个一位寄存与1个多位寄存器资源比 ...; 989 18 1 19

fpga编程对资源的影响

用户1645821 2014-9-26 15:21: 革命型SDNet满足向软定义网络演进的需求; 日前，赛灵思公司(Xilinx )推出了“软”定义网络解决方案，将可编程能力和智能化功能从控制层扩展至数据层。其推出的针对网络的SDNet软件定义规范环境通过将 ...; 839 17 0 17

fpga soc 软件定义网络

用户1645821 2014-9-26 15:19: SoC成高端FPGA设计趋势，基于SoC FPGA的开发板销量大增; 日前，Altera公司举办了Altera SoC合作伙伴研讨会，邀请了该公司知名的合作伙伴以及优秀的本土设计公司。今年的研讨会主要是请方案设计提供商来做演讲，并重 ...; 884 13 0 13

fpga soc

用户1645821 2014-9-26 15:19: iCE40 ULTRA FPGA为消费类产品打造差异化设计; 智能手机和平板电脑市场火热，技术发展迅速。这类产品需要保持超薄的尺寸、强大的功能、较长的电池续航时间以及有个性的差异化。针对手机功能差异化的市场需 ...; 973 18 0 18

智能手机 fpga 平板电脑可穿戴设备

用户446166 2014-9-25 09:32: altera的EPCS选型; 最近公司领导突然说要将以前的FPGA配置芯片换成EPCS系列，涉及到了器件选型，由于行业原因，不会用到高端FPGA，选用的cycloneii的EP2C5系列的，查了 ...; 5315 25 6 31

fpga altera epcs

wiliamzhou_446210705 2014-9-22 22:58: 串口通信之发送模块; 上篇博文介绍了一下UART接收模块，这篇我们谈一谈发送模块。发送模块将需要传输的 8 位数据以字符帧格式发送出去。那我们就开门见山，发送模块由哪些模 ...; 3109 18 1 19

verilog uart

用户1777143 2014-9-22 18:21: sdram初始化; 初次写博客，记录一下时光，一名大三的在校生........ 一下午的仿真居然是时间period设置了错误。。。贴一下仿真图代码如下 ...; 719 12 1 13

sdram

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