FPGA和CPLD-可编程逻辑器件-第211页-面包板社区

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coyoo 2012-12-3 12:33: JIC相关; 有人在altera论坛提出有关JIC产生的问题，有几个精彩的答复，在此提取以供学习。原始帖子链接在这里：http://www.alteraforum.com/forum/show ...; 5432 9 0 9

fpga altera

coyoo 2012-12-3 12:32: SignalTapII新特性-Storage Qualification; SignalTapII给FPGA调试带来了方便，但是相应的消耗了器件内置的Memory，为了有效的利用这些Memory从QuartusII8.1开始加入了一个新特性Storage ...; 4362 10 0 10

altera quartus

coyoo 2012-12-3 12:31: QuartusII9.1 安装的一个小Issue; QuartusII9.1安装的时候，如果硬盘格式是FAT32则会出现下面的error “ File Error: directory or file cannot be created (0x52) ” 解决的方法最 ...; 3185 9 2 11

altera quartus

coyoo 2012-12-3 12:31: 使用SignalProbe; FPGA的验证调试，仿真喜欢使用ModelSim，调试喜欢使用Altera的SiganlTapII。最近有个板子由于在硬件设计的时候没有预留JTAG，导致无法使用Sig ...; 5673 9 1 10

signalprobe

coyoo 2012-12-3 12:30: 通过tcl管理QuartusII工程版本的一种方法; 在Altera论坛里看到有人提到一个使用tcl管理项目版本的问题，其参考的方法在altera的官方网站有介绍：http://www.altera.com/support/examples/tcl/tcl-versi ...; 5654 10 0 10

altera quartus

coyoo 2012-12-3 12:24: Altera双口RAM读时序问题; 项目中需要设计一个直方图，分析直接采用Altera的双口RAM就可以实现，为了控制简单，就采用了单时钟（即读写同时钟）接口。例化Altera的双口RAM后，分析其给 ...; 18590 14 3 17

altera ram

coyoo 2012-12-3 12:23: 跨时钟域传递多个控制信号; 阅读Altera的HardCopy时序收敛设计指导手册的时候看到其中处理跨时钟域传输多个控制信号的方法,摘下来收藏. 说接收端需 ...; 3716 18 2 20

clock skew domain

coyoo 2012-12-3 12:23: HardCopy推荐的复位结构-再谈异步复位同步释放; 异步复位我们知道是释放的时候存在亚稳态的危险，所以通常做法就是给异步复位信号加同步器。如下图所示：上图中异步复位从引脚进来，被连在触 ...; 4945 20 0 20

hardcopy

coyoo 2012-12-3 12:17: 【博客大赛】【原创】Virtual JTAG调试平台的建设; Virtual JTAG megafunction 端口定义表1 VJ核输入端口 Port Name Required ...; 4229 16 9 25

博客大赛 altera jtag，sdram，fifo

coyoo 2012-12-3 12:16: 【博客大赛】【原创】ALTERA的FIFO的读写控制; 为了防止数据堵塞在FIFO里，所以不使用FIFO的almost empty和almost full来控制避免对满FIFO的写以及对空FIFO的读。假如简单的使用FULL信号来控制F ...; 3515 14 7 21

博客大赛 altera

coyoo 2012-12-3 12:15: 【博客大赛】【原创】FPGA与MCU异步通讯的同步化实践; FPGA+MCU是一中非常流行的架构，MCU的并行总线在和FPGA通讯的时候一般都是异步的。常见的MCU有单片机、ARM以及DSP等等， ...; 3515 9 3 9

博客大赛 fpga

coyoo 2012-12-3 12:15: 【博客大赛】【原创】Auto Detect虚惊一场; 新做的板子焊接完了，准备上电调试。在打开programer进行JTAG探测的时候发现能探测到JTAG链上的2个器件，但是均提示“unkown”，如图1所示，根据 ...; 2693 14 0 6

博客大赛 jtag

coyoo 2012-12-3 12:15: 【博客大赛】【原创】多电缆以及单链多FPGA在Virtual JTAG应用中的识别问题; 我们知道一个JTAG链通过菊花链的方式可以挂多个FPGA或者CPLD，同时同一台电脑上可以同时插有多种，或者一种多根电缆的情况。那么象这种情况，在Vi ...; 1722 13 35 41

jtag 博客大赛 fpga

coyoo 2012-12-3 12:14: 【博客大赛】FPGA外挂SDRAM调试遇到的两个问题; 第一个问题是，SDRAM上电后默认存储的是什么数据？随机数据吗？通过实验似乎是随机数据，如下图所示但是在调试的时候 ...; 2739 9 0 6

博客大赛 fpga

coyoo 2012-12-3 12:14: 【博客大赛】目前在使用TCL创建Virtual JTAG平台时待解决的几个问题; 工具命令行语言（TCL）在测试领域的应用应该还是比较广泛的，目前感觉它的几个特点或者好处是指令简单，不需要编译器，程序即为可执行状态，还有 ...; 2379 19 0 16

博客大赛 tcl

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