FPGA和CPLD-可编程逻辑器件-第137页-面包板社区

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FPGADeveloper 2014-6-1 23:36: Modelsim 软件安装与仿真库实现; Modelsim 软件安装与仿真库实现详细 ...; 1062 19 0 19

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特权ilove314 2014-6-1 22:20: 基于Toolkit的Altera Cyclone-V Gbits Transceiver测试; Altera Cyclone-V Gbits Transceiver 测试对 FPGA 内嵌的 Gbits Transceiver 早有耳闻，此番拿到一块 Terasic 的 Cyclone V GX Sta ...; 6080 23 5 28

fpga transceiver gbits

小墨同学 2014-6-1 21:36: 零基础学FPGA（八）浅谈状态机; 前几天收到一封邮件，说我在EDNchina博客大赛中获了奖，我打开一看，还真是，而且一下就获了两个，一个三等奖，一个原创新人奖。然后我就想了一下， ...; 5440 6 0 6

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用户1707279 2014-5-31 10:12: 评论：@emesjx's Blog 博客中提到的“Nios II IDE 与 Nios II SBT for Ecl...”; 难怪我用Nios II EDS打开的近期做的那个工程老是报错，虽然重建了工程将问题解决，但不知原因，这篇文章很好的解惑了。 ...; 694 10 0 10

sunyzz 2014-5-30 19:28: 贱卖高端FPGA开发板喽; http://bbs.ednchina.com/FORUM_POST_39_527881_0.HTM; 1219 15 0 15

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FPGADeveloper 2014-5-30 00:24: Xilinx ISE安装与环境设计; ...; 1073 14 0 14

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FPGADeveloper 2014-5-29 23:56: UART-DEMO出炉; 本DEMO是围绕UART进行波形打印学习模块本软件界面如下图：正旋波：方波：锯齿波：以上为波形图本软件不仅附带UART-DEM ...; 1076 15 0 15

pengchengcheng082_593158939 2014-5-29 21:21: 异步 FIFO based on SRAM; 异步FIFO 用于不同时钟域数据的交换。设计难点：在不同时钟域里，如何比较读写指针？为了比较不同时钟产生的指针，需要把不同时钟域的信号 ...; 2127 13 0 13

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pengchengcheng082_593158939 2014-5-29 21:16: 同步FIFO based on SRAM; 先看看双口RAM 同步FIFO 是指读写时钟是同一个时钟！空满判断依据：写指针追上读指针，就是满；读指针追上写 ...; 1043 13 0 13

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pengchengcheng082_593158939 2014-5-29 20:42: 二进制与格雷码转换; 转自：http://wenku.baidu.com/link?url=FUtk7jrlWXFhZ-W7MDzCU5eZ5uot9F8floh6xa2E5vVdQnCXGJZBDn05lBuEKhM_4uQwsrbaEzLyyYm9lBRvMo2R3pLkZDyE_NOs6 ...; 954 11 0 11

算法

pengchengcheng082_593158939 2014-5-28 22:01: 使用TortoiseSVN从opencores上下载资源; 使用TortoiseSVN从opencores上下载资源！转自 http://hi.baidu.com/lixu1113/item/5b1764f52ddb2ed543c36a4a 2009.3,opencores将版本控制工具由cvs变 ...; 998 10 0 10

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特权ilove314 2014-5-28 20:05: 基于JTAG和Flash Programmer的NIOS II工程代码固化烧录; 基于 JTAG 和 Flash Programmer 的 NIOS II 工程代码固化烧录 5.10.1 概述 Quartus II 硬件工程会产生一个 .sof 的下载文 ...; 3929 19 0 19

fpga flash jtag

用户441877 2014-5-28 14:56: 语句内时延和语句间时延的区别; 　　时延可以细分为两种类型: 　　1) 语句间时延: 这是时延语句执行的时延。　　2) 语句内时延: 这是右边表达式数值计算与左边表达式赋值间 ...; 951 3 0 3

fpga 语句内时延语句间时延

pengchengcheng082_593158939 2014-5-28 10:14: 由 FIFO 引发的一点思考; 在工程中，FIFO 是一个经常用到的模块，进行不同时钟域数据的转换。在用FPGA时，FIFO直接调用IP核，简单、实用。昨天晚上，在网上看到百度一个笔试题，用 SRA ...; 975 11 0 11

fpga

用户1714250 2014-5-27 11:33: 赛灵思SDNet体现未来网络发展趋势; SDNet ，指的是面向网络的软件定义规范环境（ Software Defined Specification Environment for Networking ），赛灵思于今年在拉斯维加斯举行的 Interop ...; 1758 30 0 30

fpga 赛灵思 programmable sdn sdnet

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