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用户1690049
2014-4-22 11:15
基于CYUSB3014 USB3.0总线开发技术
1.引言 USB(Universal Serial Bus,通用串行总线)以其无需配置、即插即用等特性获得了广泛的应用。2004年提出的USB2.0标准,传输速度最大能够达到480Mbps ...
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Hoki
2014-4-22 11:00
【博客大赛】9.Output Delay Constraints实例(Timing Constraints in Vivado)
本节讲解一下 output delay 的实例。依旧是 Ethernet PHY 和 FPGA 的接口,框图如图 1 所示,其中 TX 接口, MII 管理接口输出 ...
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xdc
小墨同学
2014-4-21 16:49
[博客大赛]零基础学FPGA(五)Verilog语法基基础基础(下)
9、关于任务和函数的小结,挑几点重要的说一下吧 (1)任务具有多个输入、输入/输出和输出变量,在任务重可以使用延迟、事件和时序控制结构,在任务重可以 ...
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fpga
博客大赛
小墨同学
2014-4-21 16:48
[博客大赛]零基础学FPGA(四)Verilog语法基基础基础(中)
我们接着上篇文章继续学习,上次提到了两种赋值语句,让我们接着往下学。 1、块语句 块语句包括两种,一个是顺序块,一个是并行块 ...
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fpga
博客大赛
小墨同学
2014-4-21 16:48
[博客大赛]零基础学FPGA(六)关于我最近的情况
开学快两个月了,怎么说呢,感觉自己每天过的好没劲...这学期课程比较多,而且难度普遍加大,感觉自己好像得了厌学症一样,不知道是不是被身边的人传 ...
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博客大赛
460114537_680770963
2014-4-21 16:45
[博客大赛]【FPGA】基于DE2-70的VGA控制显示
一、概述 本文将讲述基于FPGA的VGA显示控制原理,并在 Altera的DE2-70 FPGA开发板上实现以下效果:利用VGA控制,使液晶显示器显示一幅 ...
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fpga
altera
verilog
博客大赛
vga
用户428005
2014-4-20 20:11
评论:@LIU_XF 博客中提到的“关于 modelsim仿真时出现No objects found ...”
非常不错,解决了我的问题
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460114537_680770963
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可综合,指的是所设计的Verilog代码能转化为具体的电路网表(Netlist)结构。在FPGA/CPLD中器件实现的设计中,综合就是将verilog语言描述的行为 ...
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2014-4-18 21:37
菜鸟起飞之verilog感悟
学习fpga已经半年了,内心一直渴望编几行代码,可是一打开电脑就对代码有种畏惧感总害怕自己编不好,会报错。自己买了个板子,也烧进去几个程序(毕竟有单 ...
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2014-4-18 08:24
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pengchengcheng082_593158939
2014-4-16 19:10
CPU的生产过程
2013年,集成电路行业的进口额已超过原油,成为我国第一大进口商品。 我国IC行业,设计、晶圆制造以及封装三大环节,全线落后。 CPU的生产过 ...
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pengchengcheng082_593158939
2014-4-15 21:19
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所在实验室是“宽带与智能信息处理”,主要进行“阵列信号处理”,“穿墙雷达”和“探**达”方面的研究。近几年医疗电子比较火,像B超,彩超,CT等等,查查资料 ...
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pengchengcheng082_593158939
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写testbench思路
1、 testbench 中要有激励; 2、 testbench 最好实现自动验证结果,复杂的设计用波形来观察结果比较困难; 3、 最好使用一些系统函数,监测结 ...
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