FPGA/CPLD
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用户1321251 2012-3-14 16:07
【博客大赛】verilog异或校验的两种写法,哪一种写法是正确的?伤不起
check_o   = (dat_o ^dat_o ^dat_o ^dat_o ^dat_o ^dat_o ^dat_o ==dat_o );     check_o   = ((dat_o ^dat_o ^dat_o ^dat_o ^dat_o ...
用户213742 2012-3-12 08:40
【博客大赛】【原创】跨时钟域的信号传递
同频异相传递: 一种简单的解决办法是用两级寄存器pipe一下,第二级寄存器的输出Q基本上不会有亚稳态,但是这种办法并不能保证最后的输出结果一定是正确 ...
用户213742 2012-3-12 08:40
【博客大赛】【原创】Cyclone-II驱动2.4寸TFT液晶显示彩条
网上买来的21EDA的CycloneII开发板,拿到手的第一件事就是兴致勃勃地驱动TFT,哎,老本行,虽然现在的工作已经跟显示技术无关了,但是兴趣还在的。 ...
用户419742 2012-3-8 20:47
【博客大赛】【原创】TimeQuest约束外设之ddio的潜规则
  最近调试了下altera里的ddio模块,在Timequest约束ddio_out输出时,遇到了一个其实不算是问题的问题。 ddio_out模块如图1所示。 ...
用户567526 2012-3-8 09:45
【转】说说Timing这回事
Intro 问:一个FPGA设计项目需要用哪些评判标准来检验? 功能正确; 时序收敛; 资源消耗少。 ...
用户1617946 2012-3-6 17:24
【博客大赛】【原创】看到FPGA就想说点
FPGA现在很火~将来暂时也是会很火~它比ARM相对来说高端点吧~相对来说入门有门槛~不关说知识学习方面的高度~学习成本也是一个不小的门槛~说来也惭愧~虽然学过 ...
bitao1983_395643617 2012-3-6 10:52
【博客大赛】[原创] 近一个月的成果!!!
        FPGA的以太网接口,使用的芯片是DM9000AEP,上位机给固定IP发送UDP数据包,在下位机的FPGA中接收到了完整的数据包!!!         特别感 ...
用户611588 2012-3-4 20:25
两种按键防抖动方法
一、module key                /*此按键消抖方法,如果按键时间足够长的话会触发两次                          ...
用户611588 2012-3-4 16:18
流水灯 verilog总结
流水灯 verilog总结:  关于分频技术参数N,verilog中定义22位参数N,参数N 超过22位,未进行报错;  最小系统板上led初始状态点亮,赋值 ...
用户611588 2012-3-4 13:42
verilog的计数器
verilog编写计数器,初复位外,先计数,(再考虑归零问题,区别于vhdl),到最大值11+01=100,系统自动吧预设带宽即低两位赋给计数变量 ...
用户1575055 2012-3-2 09:50
【博客大赛】【原创】设备开发之数电模电
这是我以前在该论坛发的一个帖子,当时只写了模电,可参考 http://bbs.ednchina.com/FORUM_POST_33_175822_0.HTM   今天看到这个活动,开下博客,再发下, ...
用户1600457 2012-3-1 22:48
【博客大赛】 modelsim仿真ROM的注意点
mif文件是用来给Quautus综合网表用的,而hex可以被用来作为modelsim仿真的数据输入用。换句话说modelisim对mif文件不支持,而只对hex文件支持。 用models ...
用户404801 2012-2-28 22:59
图像的直方图均衡
1,MATLAB代码: clear all %一,图像的预处理,读入彩色图像将其灰度化 PS=imread('1.jpg');                 %读入JPG彩色图像文 ...
用户1600457 2012-2-21 21:19
流水线加法器(适用符号型数据)
所谓流水线的概念可能大家都不陌生,通俗的讲就是本来是一条龙服务的,现在将整个环节分割成几小段,然后让这几个分段同时开始各自的工作,最后将这些小段连 ...
用户1600457 2012-2-15 16:51
FPGA中系统运行频率计算方法(转)
我们的设计需要多大容量的芯片?我们的设计能跑多快?这是经常困扰工程师的两个问题。对于前一个问题,我们可能还能先以一个比较大的芯片实现原型,待原型完 ...
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