FPGA/CPLD
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用户1644113 2012-2-14 14:19
【转】说说Timing这回事
【转】说说Timing这回事 Intro 问:一个FPGA设计项目需要用哪些评判标准来检验? 功能正确; ...
用户245909 2012-2-6 12:44
高速信号采集USB2.0传输系统设计
作者:herizon_fei      之前做一个项目,需要对微弱光信号进行较高速(采样率1M)的8位信号采集,然后将数据传输到PC,交由上位机进行处理。这里将 ...
用户1644113 2012-2-5 20:24
FPGA学习笔记2-Quartus2简介
FPGA学习笔记2-Quartus2简介 Quartus2简介 特性概述 全集成设计工具: 多种设计输入方法 逻辑综合 布局布线 仿真 时序和功耗分 ...
用户1644113 2012-2-5 18:06
FPGA学习笔记1-基础与配置
FPGA学习笔记1-基础与配置   FPGA优点和基础 解决工程师的问题: 更短的设计周期 标准不断发展 突出的产品优势 更好的性能 有限的 ...
用户413306 2012-2-4 16:38
vhdl 变量与信号区别 type符号使用
以下内容是转帖自:http://blog.sina.com.cn/s/blog_679178c30100jmry.html  1.VHDL描述的是硬件,而不是软件。在所有的设计开始之前在心目中都应当有一 ...
用户413306 2012-2-4 12:42
一个简单的加法状态机
    下面是一个状态机的程序,是我们的一个项目工程中的一段,只是思想比较简单,所以说我把它给摘录了下来,以后工程项目中可以用到 proc ...
用户413306 2012-2-4 12:28
博客主要功能介绍
本人qq:117838621,昵称:司令 本人在此开博的目的是在学习fpga/cpld/vhdl/verilog 的学习过程中遇到的问题和解决的方法,以及学习中涉及的程序代码等发 ...
用户413306 2012-2-4 12:13
vhdl 从d触发器程序理解vhdl语法
  以下内容是 根据《eda技术使用手册》第三版中的一个实例的介绍 下面是一个d触发器的代码 LIBRARY IEEE ; USE IEEE.STD_LOGIC_1164.ALL ; ...
用户413306 2012-2-3 23:09
verilog 入门共阳极流水灯
  //流水灯:Max300a 3128atc100-10,24Mhz,led是共阳极的。 //实现的功能中间每隔1s点亮流水灯。 //流水灯:Max300a 3128atc100-10,24Mhz ...
用户413306 2012-2-3 23:01
以半加器 解释vhdl case 元件例化等语法
  【例4-20】 LIBRARY  IEEE;   --半加器描述(2) USE IEEE.STD_LOGIC_1164.ALL;  ENTITY h_adder IS  PORT (a, b : IN STD_LOGI ...
用户413306 2012-2-3 22:57
quartus ii 波形仿真例子:计数器设计
  quartus ii 波形仿真例子:计数器设计   发布时间:2012-02-03 18:53:38  简单介绍一下我学习如何使用quartus ii进行波形仿真,作为以后使用, ...
用户405107 2012-2-3 20:09
quartus ii 波形仿真例子:计数器设计
简单介绍一下我学习如何使用quartus ii进行波形仿真,作为以后使用,下面是计数器的vhdl代码 library ieee; use ieee.std_logic_1164.all; use i ...
用户1407039 2012-2-3 14:31
FPGA+USB3.0开发板 CYUSB3014开发板 FX3开发板 USB3.0开发板
产品介绍:     usb3.0-altera-ddr2开发板( 简称USB3.0开发板 )是开发板中心精心设计的一款 FPGA+USB3.0开发板 , 主芯片架构为:CYUSB3014(FX3系 ...
用户405107 2012-2-2 19:31
quatus ii 设置字体大小
点击:tools--option 出来一个对话款,有很多设置字体的大选项,找到text editor 下面的font,点击后修改就可以了。   ...
用户405107 2012-2-1 21:13
以半加器 解释vhdl case 元件例化等语法
【例4-20】 LIBRARY  IEEE;   --半加器描述(2) USE IEEE.STD_LOGIC_1164.ALL;  ENTITY h_adder IS  PORT (a, b : IN STD_LOGIC;      ...
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