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AD采样数据同步问题
以前设计中将AD的时钟是FPGA使用DCM分频产生的30M,而FPGA内部采集数据的时钟也是使用同一个时钟分频产生的30M,在截取AD采集的数据时没有出现不 ...
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要实现8位加法,先要从1位开始。假设A,B,C_1分别为两个输入值和进位输入,S是和值,C为进位输出值,于是便有以下表达式: S=A xor B xor C_1; ...
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最近整个串口通信,好几天还没弄好,头大,程序问题在哪里
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【博客大赛】【原创】我对FPGA的理解
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bitao1983_395643617
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【博客大赛】Spartan6老配置电路的新问题
我以前做了一块Spartan6LX45的开发板,配置电路如下图,由于产品化 的需要将开发板精简,只是对M0和M1的连接做了修改,以前使用跳线选择, ...
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【博客大赛】verilog异或校验的两种写法,哪一种写法是正确的?伤不起
check_o = (dat_o ^dat_o ^dat_o ^dat_o ^dat_o ^dat_o ^dat_o ==dat_o ); check_o = ((dat_o ^dat_o ^dat_o ^dat_o ^dat_o ...
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【博客大赛】【原创】跨时钟域的信号传递
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用户419742
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【博客大赛】【原创】TimeQuest约束外设之ddio的潜规则
最近调试了下altera里的ddio模块,在Timequest约束ddio_out输出时,遇到了一个其实不算是问题的问题。 ddio_out模块如图1所示。 ...
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FPGA现在很火~将来暂时也是会很火~它比ARM相对来说高端点吧~相对来说入门有门槛~不关说知识学习方面的高度~学习成本也是一个不小的门槛~说来也惭愧~虽然学过 ...
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bitao1983_395643617
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【博客大赛】[原创] 近一个月的成果!!!
FPGA的以太网接口,使用的芯片是DM9000AEP,上位机给固定IP发送UDP数据包,在下位机的FPGA中接收到了完整的数据包!!! 特别感 ...
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