FPGA/CPLD
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用户1664191 2015-1-9 13:19
跨时钟域时序约束
 在一个FPGA设计里面,经常会用到多个全局时钟,而这些全局时钟是通过几个外部时钟晶振从全局时钟管脚(GC)输入后,再经过一些时钟管理模块产生的(如DCM、P ...
用户425451 2015-1-5 22:27
20150105
第一天,fpga的输入端信号 不可以直接定义为线网类型,可以定义一个新名称为线网类型,再让输入端信号赋值等于它即可,quartus ii中的signal tap ii中综合下 ...
用户1664191 2015-1-5 19:47
评论:@FPGA乐园! 博客中提到的“FPGA设计要点之一:时钟树”
自己闲下来阅读
用户436773 2015-1-4 11:52
经验总结:FPGA时序约束的6种方法
对自己的设计的实现方式越了解,对自己的设计的时序要求越了解,对目标器件的资源分布和结构越了解,对EDA工具执行约束的效果越了解,那么对设计的时序约束目标 ...
用户1664191 2015-1-4 10:09
三段式状态机的思维陷阱
用三段式描述状态机的好处,国内外各位大牛都已经说的很多了,大致可归为以下三点: 1.将组合逻辑和时序逻辑分开,利于综合器分析优化和程序维护; ...
莫问奴家名 2015-1-4 10:03
利用FPGA实现的FFT变换设计
随着集成电路的飞速发展,在图像处理,通信和多媒体等很多领域中,数字信号处理技术已经被广泛应用。快速傅立叶变换(FFT)算法的提出,使得数字信号处理的运算 ...
用户1664191 2015-1-4 09:05
skew jitter
系统时序设计中对时钟信号的要求是非常严格的,因为我们所有的时序计算都是以恒定的时钟信号为基准。但实际中时钟信号往往不可能总是那么完美,会出现抖动(Ji ...
FPGADeveloper 2015-1-2 17:16
2015年FPGA雏鹰培训计划
 
用户1664191 2014-12-29 13:58
verilog设计经验总结
先记下来: 1、不使用初始化语句; 2、不使用延时语句; 3、不使用循环次数不确定的语句,如:forever,while等; 4、尽量采用同步方式设计 ...
小梅哥 2014-12-29 13:48
小梅哥和你一起深入学习FPGA之串口调试(一)(上)
    大家好,这几天在各个论坛上,经常就有人在向我咨询基于FPGA的串口通信代码,大部分都是在网上下载一个现成的代码,但是在使用中就遇到了各种问题,于 ...
用户1664191 2014-12-29 08:56
FPGA综合实现
  在综合实现这一部分,ISE主要有5个步骤 synthesize,translate,map,placeroute,generate programming File synthesize: 工具可 ...
小梅哥 2014-12-27 15:05
小梅哥和你一起深入学习FPGA之串口调试(一)(下)
以上为小梅哥为了对特权同学的串口收发模块进行测试所展开的部分工作,到这里,仿真测试所需要的准备工作我们就做好了,接下来将实际进行仿真,通过仿真来分析 ...
小梅哥 2014-12-27 14:57
小梅哥和你一起深入学习FPGA之数码钟(下)
图中存在较多的模块,因此在此将每个模块的功能做简单介绍:       normal_keys_detect 独立按键消抖模块 Dig_Led_D ...
小梅哥 2014-12-27 14:32
小梅哥和你一起深入学习FPGA之DAC驱动
本实验中,我们使用FPGA来驱动了一片DAC芯片TLC5620,该芯片的特性如下所示:   TLC5620特性:      4路8位电压输出;      单电源5 ...
小梅哥 2014-12-27 14:18
小梅哥和你一起深入学习FPGA之PS2键盘驱动
  小梅哥和你一起深入学习FPGA之PS2键盘驱动     在我们的电子系统中,当需要用到大量的按键输入时,普通的独立按键和矩阵键盘已经无法满足 ...
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