FPGA和CPLD-可编程逻辑器件-第131页-面包板社区

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阿昏豆 2014-8-2 17:45: FPGA研发之道(22)-交换矩阵; 如果在 FPGA 设计中，需要多端口，大数据量的交换，那么交换矩阵则是一个不错的实现方案。交换矩阵使用的目的主要有几个，一，灵活的端口转发。通过交 ...; 2908 8 2 10

fpga 设计交换矩阵

莫问奴家名 2014-7-31 15:24: 评论：@特权's Blog——永远忠于年轻时的梦想！博客中提到的“FPGA\CPLD设计学习笔记”; 好; 755 12 0 12

莫问奴家名 2014-7-31 09:20: 评论：@零基础学FPGA学习日记博客中提到的“零基础学FPGA (一) 关于我和FPGA”; 好; 593 8 0 8

用户604801 2014-7-29 22:51: 开始新的征程; 距离第一篇开篇已经过去了1年半了，这段时间内积累了很多，疑问更多，这一年里，收获颇多，错过也很多，该是静心冥思的时候了。 2014年7月29日22:51:31 ...; 885 7 2 9

fpga

用户1738264 2014-7-29 21:57: 基于FPGA的图像采集系统设计与实现; 　　 1、引言　　视频图像采集是视频信号处理系统的前端部分，正在向高速、高分辨率、高集成化、高可靠性方向发展。图像采集系统在当今工业、军事、医学各 ...; 928 11 0 11

图像采集 FPGA Quartus SRAM ADV7181

阿昏豆 2014-7-28 23:19: FPGA研发之道(21)-鸡肋?; 通常认为， SOPC 是 FPGA 设计中的鸡肋，“弃之可惜，食之无味”。诚然， SOPC 一直不是 FPGA 的主流应用设计，制约主要因素则是性能，因为 ...; 2513 11 2 13

fpga 设计 soc

阿昏豆 2014-7-27 17:20: FPGA研发之道(20)-片上系统; 从最初的占地 170 平方的第一代 ENIAC 计算机开始，计算机开始了不断集成化、小型化的发展之旅。现今在单一芯片内部已经能够集处理器，存储，各型协处 ...; 2308 13 0 13

fpga 设计片上系统

阿昏豆 2014-7-26 23:02: FPGA研发之道(19)- “背靠大树好乘凉”--总线(下); 如果说在 PC 时代，垄断 PC 江湖的是 WINTEL （微软和英特尔），那么在移动互联网时代，最具有这个潜质的就是谷歌的 andriod 操作 ...; 2424 9 0 9

fpga 设计总线

用户1484351 2014-7-26 13:17: 评论：@阿昏豆博客中提到的“FPGA研发之道(16)-可测性设计—从大数据开始说起”; 学习下; 647 22 0 22

阿昏豆 2014-7-24 23:00: FPGA研发之道(18)-设计不是凑波形(八)总线（上）; 如果设计中有多个模块，每个模块内部有许多寄存器或者存储块需要配置或者提供读出那么实现方式有多种，主要如下：实现方式一：可以在模块顶 ...; 2693 9 2 11

fpga 设计总线

阿昏豆 2014-7-23 20:35: FPGA研发之道(17)-化繁为简; 有个笑话说，有个病人感冒了，于是去看医生，医生诊断后说，你得了感冒，但是我只会治疗肺炎，不如你回家再浇点凉水，把病恶化成肺炎，那我 ...; 3829 16 4 20

fpga 设计

阿昏豆 2014-7-22 19:46: FPGA研发之道(16)-可测性设计—从大数据开始说起; 当下，最火的学问莫过于《大数据》，大数据的核心思想就是通过科学统计，实现对于社会、企业、个人的看似无规律可循的行为进行更深入和直观的了解。 F ...; 2638 18 2 20

fpga 设计 verilog

阿昏豆 2014-7-21 21:20: FPGA研发之道(14)写在coding之前的铁律; 写在 coding 之前的那些铁律 (1) 注释：好的代码首先必须要有注释，注释至少包括文件注释，端口注释，功能语句注释。文件注 ...; 3445 11 4 15

fpga 设计 verilog

用户1758873 2014-7-21 19:15: 评论：@阿昏豆博客中提到的“FPGA研发之道（8）架构设计漫谈（三）时钟和复位”; 不错; 611 5 0 5

阿昏豆 2014-7-20 21:19: FPGA研发之道(15)-设计不是凑波形（五）接口设计; 作为 FPGA 工程师来说，碰到新的问题是设计中最常见的事情了，技术发展趋势日新月异，所以经常会有新的概念，新的需求，新的设计等待去实现。不是每个通过 ...; 2164 11 1 12

fpga 设计接口

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