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用户440448
2013-10-13 06:05
1.6节 K图应用:七段译码器 part2
现在放出上一部分的答案: 1.先看K图设计(根据输入的顺序不同,可能和大家的设计有所不同): 注意一下这里如果输 ...
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2013-10-12 09:45
1.6节 K图应用:七段译码器
那么有了上面的卡诺图,我们来看看应用,同时把卡诺图的如何圈1的方法用两节的时间让大家掌握并能够灵活运用。 1.准备知识: a。7段数码管的结构 ...
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用于实现嵌入式安全的开源硬件
想像一下你正在排队等待参加一个重要活动。门票是通过网上购买的,存储在你的智能手机中。你需要将手机放到某个指定区域上,建立起NFC连接,门票随之得到确认, ...
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IP核
用户440448
2013-10-11 11:33
1.4补充 三态缓存(tristate buffer)与 多路复用器(Multiplexers)
由于发现后面忘了给出答案在此补充一下: 用三态实现MUX最一般的做法: 由于这个设计受外界杂音影响很大(Non-Restoring!)所以我们可以利用一 ...
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用户443437
2013-10-11 10:27
人工智能的未来---FPGA(六)
六、新大脑皮层的多层结构与特征序列处理机制我们若用实验的方法对视觉处理区域进行观察,就会发现它的逻辑结构具有多层性,最基本的视觉区是 V1 区,它由 ...
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用户440448
2013-10-11 10:07
第一章1.1 回顾CMOS的一些知识
对于CMOS大家多少都有所耳闻吧,即使不知道也没关系。因为我在这里会从零基础讲到专业级设计的内容也就是从通俗易懂到“高深”理论(其实一点都不难懂 ...
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用户440448
2013-10-10 19:18
1.5节 卡诺图以及布尔代数(SOP,POS) part3
有认真做上一部分的联系么。现在给出(b)的答案: 1. Y=~A~B~C+A~ B~C+A~BC 2.Y=~B~C+A~B 或 第一种叫做PLA模 ...
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Altera FPGA 的 IOE DDR寄存器 介绍 王敏志 概述 本文对 Altera 器件 IOE 的 DDR 功能 ...
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用户443437
2013-10-10 12:15
三角波发生器的RTL视图,一个是VHDL写的,一个是verilog写的
刚才写的三角波发生器的RTL视图,感受一下VHDL与verilog的硬件描叙语言魅力,不过verilog写的三角波,我用了状态机写的,所以有点差别,但是表达的硬 ...
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用户444977
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