FPGA和CPLD-可编程逻辑器件-第52页-面包板社区

 

FPGA/CPLD

首页 FPGA/CPLD

简单qqq 2019-7-17 13:21: 为FPGA 设计电源管理，有几点要素要牢记！; 为 FPGA 应用设计优秀电源管理解决方案不是一项简单的任务，相关的技术讨论有很多很多。今天小编要为大家分享的内容『FPGA 的电源管理』主要有两个目的—— ...; 2149 13 0 2

布兰姥爷 2019-7-16 16:45: 原创【零基础】一文读懂CPU（从二极管到超大规模集成电路）; 一、前言　　我们都知道芯片，也知道芯片技术在21世纪是最重要的技术之一，但很少有人能知道芯片技术的一些细节，如芯片是如何构造的、为什么它可以运行 ...; 9802 61 2 11

CPU 集成电路二极管芯片

用户3879107 2019-7-10 17:29: 高度集成的可编程逻辑器件fpga芯片处理能力与作用; 可编程逻辑器件（ PLD）是一种半定制的通用器件，允许用户对PLD器件进行编程，以实现所需的逻辑功能。与ASIC相比，PLD具有灵活性高，设计周期短，成本低，风 ...; 1270 15 0 15

panda君 2019-7-6 22:45: 原创 Panda侃技术，聊一聊国产FPGA; Panda 侃技术，聊一聊国产 FPGA 作者：Hello，Panda 偷 ...; 8299 40 6 12

国产FPGA

用户3879107 2019-7-5 16:05: 国产fpga芯片电子元器件芯片未来的发展多样化分析; 全球市场份额不到 10％;中国占芯片下游最重要的原材料份额，中国的全球市场份额缺乏1％;然而，中国的集成电路公司正在不断完善，如方海思，展瑞，长江电子， ...; 1932 19 0 1

电子元器件半导体

小梅哥. 2019-7-2 08:57: 原创小梅哥FPGA时序分析笔记（五）I/O约束显神威——深入龙潭; 大家一定对我上一节的突然结尾表示一脸茫然：我是来学习时序约束的，然后你告诉我时序约束里面 IO 约束很重要，然我又跟着你的文章继续往下看，本以为你就 ...; 11977 62 5 12

fpga 时序分析小梅哥时序约束

小梅哥. 2019-6-30 11:07: 原创小梅哥FPGA时序分析笔记（四）I/O时序定成败——化险为夷; 小梅哥FPGA时序分析从遥望到领悟系列没有遇见过 I/O 时序问题，没有通过 I/O 约束方式实际解决过 I/O 时序问题，就很难明白 I/O 约束 ...; 13737 69 1 19

小梅哥 fpga 时序约束时序分析教程

五街彭于晏 2019-6-27 11:08: php+中文分词scws+sphinx+mysql打造千万级数据全文搜索 02; 2、安装Sphinx yum install expat expat-devel wget -c http://sphinxsearch.com/files/sphinx-2.0.7-release.tar.gz tar zxvf sphinx-2.0.7-release.tar.gz ...; 2474 12 1 2

五街彭于晏 2019-6-27 10:56: php+中文分词scws+sphinx+mysql打造千万级数据全文搜索; Sphinx是由俄罗斯人Andrew Aksyonoff开发的一个全文检索引擎。意图为其他应用提供高速、低空间占用、高结果相关度的全文搜索功能。Sphinx可以非常容易的与SQL ...; 1230 12 0 12

小梅哥. 2019-6-22 10:32: 原创小梅哥FPGA时序分析笔记（三）时钟约束真重要——事实说话; 小梅哥FPGA时序分析从遥望到领悟系列以前，那是在以前，经常有网友（原谅我行文动不动就是网友说，网友问，毕竟我是卖开发板的，正面接触学 FPGA ...; 20092 89 7 21

小梅哥 FPGA 时序约束时序分析

小梅哥. 2019-6-21 10:33: 原创小梅哥FPGA时序分析笔记（二）时钟质量是生命——初遇时序; 小梅哥FPGA时序分析从遥望到领悟系列第一次遇到时序问题并通过相应的手段解决问题，算是 2 年前做百兆以太网图像传输的时候了吧。当时遇到的问题为 ...; 14461 91 6 13

小梅哥 FPGA 时序分析时序约束

狂野的牛哥 2019-6-20 16:34: 原创 ZYNQ学习笔记之First Project; 做了第一个Project 该工程功能： PS内部定时器开启定时，PL端GPIO连接按键和LED，通过按键按下产生从PL到PS的中断，中断服务程序是控制LED灯做流水灯闪烁， ...; 2503 21 1 5

狂野的牛哥 2019-6-20 15:30: 原创 ZYNQ学习笔记之时钟相关; 通常模式下，锁相环PLL是启动的，PS-CLK提供时钟信号，经过三路PLL，分别是：ARM PLL，产生时钟用于CPU和互联；IO PLL，产生时钟用于IO外围设备；DDR PLL， ...; 5370 19 1 3

小梅哥. 2019-6-20 11:46: 原创小梅哥FPGA时序分析笔记（一）学了4年才学会——废话连篇; 小梅哥FPGA时序分析从遥望到领悟系列这么取名字，大概率会被人家笑话吧，一个呆头呆脑哈里哈气的憨厚形象跃然纸上。不过呢，仗着自己脸皮不薄， ...; 16118 112 7 23

小梅哥 FPGA 时序约束时序分析

panda君 2019-6-3 10:53: 原创基于安森美Python系列CMOS的应用方案; 一、 Python 系列 CMOS 简介安森美 Python 系列传感器主要面向工业级的应用，均为全局快门， -40 ° C~+85 ° C 宽温级，可 ...; 3772 33 1 3

python1300 python5000 python25k

1 ... 48 49 50 515253 54 55 56 ... 500 / 500 页下一页

关闭站长推荐

上一条

/3

下一条