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最近做完了synopsys的DC workshop，涉及到时钟的建模/约束，这里就来聊聊数字中的时钟（与建模）吧。主要内容如下所示：
·同步电路与异步电路；
·时钟/时钟树的属性：偏移(skew)与时钟的抖动（jitter）、延时（latency）、转换（transition）时间；
·内部时钟；
·多路复用时钟；
·门控时钟；
·行波时钟；
·双沿时钟；
·Design Compiler中的时钟约束。
·补充：时钟分配策略
1、同步电路与异步电路
首先来谈谈同步电路与异步电路。那么首先就要知道什么是同步电路、什么是异步电路？
对于同步时序电路，不同的文章有不同的说法，大致有下面的定义方法：
①对于比较严格的定义：一个电路是同步电路，需要满足一下条件：
·每一个电路元件是寄存器或者是组合电路；
·至少有一个电路元件是是寄存器；
·所有寄存器都接收同一个时钟电路；
·若有环路，则环路至少包含一个寄存器。
在上面的严格定义下，可以得到下面的电路不是同步电路：
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